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参数资料
型号： TMX320C6474ZUN
厂商： TEXAS INSTRUMENTS INC
元件分类： 消费家电
英文描述： SPECIALTY CONSUMER CIRCUIT, PBGA561
封装： 23 X 23 MM, ROHS COMPLIANT, PLASTIC, FCBGA-561
文件页数： 124/204页
文件大小： 2220K
代理商： TMX320C6474ZUN
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页当前第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页
2.7 Terminal Functions
TMS320C6474
Multicore Digital Signal Processor
SPRS552 – OCTOBER 2008
www.ti.com
The terminal functions table (Table 2-5) identifies the external signal names, the pin type (I, O, O/Z, or
I/O/Z), whether the pin has any internal pullup/pulldown resistors, and the signal function description.
Table 2-5. Terminal Functions
SIGNAL
TYPE(1)
IPD/IPU(2)
SIGNAL DESCRIPTION
NAME
NO.
ANTENNA INTERFACE
AIFRXN0
AF22
I
AIFRXP0
AF21
I
AIFRXN1
AG20
I
AIFRXP1
AG21
I
AIFRXN2
AG18
I
AIFRXP2
AG17
I
Antenna Interface Receive Data (6 links)
AIFRXN3
AE17
I
AIFRXP3
AE18
I
AIFRXN4
AE14
I
AIFRXP4
AE13
I
AIFRXN5
AF12
I
AIFRXP5
AF13
I
AIFTXN0
AE21
O
AIFTXP0
AE22
O
AIFTXN1
AD21
O
AIFTXP1
AD20
O
AIFTXN2
AF16
O
AIFTXP2
AF17
O
Antenna Interface Transmit Data (6 links)
AIFTXN3
AD17
O
AIFTXP3
AD16
O
AIFTXN4
AG13
O
AIFTXP4
AG14
O
AIFTXN5
AD13
O
AIFTXP5
AD12
O
CLOCK/RESETS
NMI0
J4
I
IPD
Non-maskable interrupts. NMI0, NMI1, and NMI2 pins are mapped to C64x+
Megamodule Core 0, C64x+ Megamodule Core 1, and C64x+ Megamodule Core
NMI1
J2
I
IPD
2, respectively. NMIs are edge-driven (rising edge). Any noise on the NMI pin
NMI2
J1
I
IPD
may trigger an NMI interrupt; therefore, if the NMI pin is not used, it is
recommended that the NMI pin be grounded rather than relying on the IPD.
XWRST
AD5
I
Warm Reset
RESETSTAT
AF4
O
Reset Status Output
POR
AE5
I
Power-on Reset
SYSCLKP
AE9
I
System Clock Input to Antenna Interface and main PLL (Main PLL optional vs
ALTCORECLK)
SYSCLKN
AE10
I
ALTCORECLKN
AF10
I
Alternate Core Clock Input to main PLL (vs SYSCLK)
ALTCORECLKP
AF9
I
DDRREFCLKN
AD23
I
DDR Reference Clock Input to DDR PLL
DDRREFCLKP
AD24
I
System Clock Output to be used as a general purpose output clock for debug
SYSCLKOUT
AD6
O/Z
IPD
purposes
(1)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
(2)
IPD = internal pulldown, IPU = internal pullup. All internal pullups and pulldowns are 100
A.
Device Overview
26
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