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参数资料
| 型号： | TMX320C6474ZUN |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA561 |
| 封装： | 23 X 23 MM, ROHS COMPLIANT, PLASTIC, FCBGA-561 |
| 文件页数： | 62/204页 |
| 文件大小： | 2220K |
| 代理商： | TMX320C6474ZUN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页
7.14.1.2 Timer Watchdog Select
7.14.2 Timers Peripheral Description(s)
TMS320C6474
Multicore Digital Signal Processor
SPRS552 – OCTOBER 2008
www.ti.com
As mentioned previously, the timers can operate in watchdog mode. When in watchdog mode, the event
output from the timer can optionally reset the CPU. When used in this type of mode, Timer3, Timer4, and
Timer 5 correspond to C64x+ Megamodule Core 0, C64x+ Megamodule Core 1, and C64x+ Megamodule
Core 2, respectively. In order for the event not to trigger the reset when this operation is not desired, the
Timer watchdog reset selection register (WDRSTSEL) is created to turn this feature on/off. The
WDRSTSEL register is shown in Figure 7-37 and described in Table 7-56.
31
8
Reserved
R-0 0000 0000 0000 0000 0000 0000 0000
7
3
2
1
0
Reserved
WDRSTSEL5
WDRSTSEL4
WDRSTSEL3
R-0 0000 0000 0000 0000 0000 0000 0000
R/W-0
LEGEND: R/W = Read/Write; R = Read only; -n = value after reset
Figure 7-37. Timer Watchdog Reset Selection Register (WDRSTSEL)
Table 7-56. Timer Watchdog Reset Selection Register (WDRSTSEL) Field Descriptions
Bit
Field
Value
Description
31:3
Reserved
2:2
WRDSTSELn
Reset Select for Watchdog Timer
0
TOUTnL does not cause WDRSTSEL to assert to the corresponding C64x+ megamodule
1
TOUTnL causes a reset of the corresponding C64x+ megamodule via the host reset port of the
LPSC
Table 7-57. Timer 0 Registers
HEX ADDRESS
ACRONYM
REGISTER NAME
0291 0000
PID
Peripheral ID Register
0291 0004
EMUMGT_CLKSPD
Timer 0 Emulation Management/Clock Speed Register
0291 0008
-
Reserved
0291 000C
-
Reserved
0291 0010
TIMLO
Timer 0 Counter Register Low
0291 0014
TIMHI
Timer 0 Counter Register High
0291 0018
PRDLO
Timer 0 Period Register Low
0291 001C
PRDHI
Timer 0 Period Register High
0291 0020
TCR
Timer 0 Control Register
0291 0024
TGCR
Timer 0 Global Control Register
0291 0028
WDTCR
Timer 0 Watchdog Timer Control Register
0291 002C
-
Reserved
0291 0030
-
Reserved
0291 0034 - 0291 FFFF
-
Reserved
Peripheral Information and Electrical Specifications
154
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