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参数资料
| 型号： | ZL6100EVAL2Z |
| 厂商： | Intersil |
| 文件页数： | 7/34页 |
| 文件大小： | 0K |
| 描述： | EVAL BOARD 2CH USB ZL6100 |
| 标准包装： | 1 |
| 系列： | * |
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ZL6100
Pin Descriptions (Continued)
PIN
TYPE
NUMBER
20
21
22
23
24
25
26
27
LABEL
ISENA
VR
GL
PGND
SW
GH
BST
VDD
(Note 20)
I
PWR
O
PWR
PWR
O
PWR
PWR
DESCRIPTION
Differential voltage input for current limit. High voltage tolerant.
Internal 5V reference used to power internal drivers.
Low-side FET gate drive.
Power ground. Connect to low impedance ground plane.
Drive train switch node.
High-side FET gate drive.
High-side drive boost voltage.
Supply voltage.
(Note 22)
28
29
30
31
32
V25
XTEMP
DDC
MGN
CFG
PWR
I
I/O
I
I, M
Internal 2.5V reference used to power internal circuitry.
External temperature sensor input. Connect to external 2N3904 diode connected transistor.
Digital-DC Bus. (Open Drain) Communication between Zilker Labs devices.
Signal that enables margining of output voltage.
Configuration pin. Used to control the switching phase offset, sequencing and other management
features.
33
34
35
36
ePad
EN
DLY0
DLY1
PG
SGND
I
I, M
O
PWR
Enable input. Active high signal enables PWM switching.
Soft-start delay select. Sets the delay from when EN is asserted until the output voltage starts to ramp.
Power-good output.
Exposed thermal pad. Common return for analog signals; internal connection to SGND. Connect to low
impedance ground plane.
NOTES:
20. I = Input, O = Output, PWR = Power or Ground. M = Multi-mode pins.
21. The SYNC pin can be used as a logic pin, a clock input or a clock output.
22. V DD is measured internally and the value is used to modify the PWM loop gain.
7
FN6876.3
August 29, 2012
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