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参数资料
| 型号： | AD9882KSTZ-100 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 38/40页 |
| 文件大小： | 0K |
| 描述： | IC INTERFACE/DVI 100MHZ 100LQFP |
| 标准包装： | 1 |
| 应用： | 视频 |
| 接口： | 模拟，DVI |
| 电源电压： | 3.15 V ~ 3.45 V |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 管件 |
| 安装类型： | 表面贴装 |
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AD9882A
Rev. 0 | Page 7 of 40
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
AD9882A
TOP VIEW
(Not to Scale)
V
DD
RE
D<0
>
RE
D<1
>
RE
D<2
>
RE
D<3
>
RE
D<4
>
RE
D<5
>
RE
D<6
>
RE
D<7
>
GND
V
DD
SOGOUT
HS
OUT
VSOU
T
DE
DATACK
GND
V
DD
MDA
MCL
VSYN
C
H
SYN
C
SD
A
SC
L
A0
GND
V
D
R
TERM
V
D
V
D
GND
R
X0
–
R
X0
+
GND
R
X1
–
R
X1
+
GND
R
X2
–
R
X2
+
GND
R
XC
+
R
XC
–
V
D
PV
D
GND
PV
D
GND
FILT
PV
D
GND
1
GND
GREEN<7>
GREEN<6>
GREEN<5>
GREEN<4>
GREEN<3>
GREEN<2>
GREEN<1>
GREEN<0>
VDD
GND
BLUE<7>
BLUE<6>
BLUE<5>
BLUE<4>
BLUE<3>
BLUE<2>
BLUE<1>
BLUE<0>
VDD
GND
CTL 0
CTL 1
CTL 2
CTL 3
GND
MIDBYPASS
REFBYPASS
VD
GND
RAIN
VD
GND
VD
GND
GAIN
SOGIN
VD
GND
VD
GND
BAIN
VD
GND
VD
GND
DDCSDA
DDCSCL
PVD
GND
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
80
79
78
77
76
05123-002
PIN 1
INDICATOR
Figure 2. 100-Lead LQFP Pin Configuration
Table 4. Pin Function Descriptions
Pin Type
Mnemonic
Function
Value
Pin
Number
Interface
Analog Video Inputs
RAIN
Analog Input for Converter R
0.0 V to 1.0 V
70
Analog
GAIN
Analog Input for Converter G
0.0 V to 1.0 V
65
Analog
BAIN
Analog Input for Converter B
0.0 V to 1.0 V
59
Analog
External Sync/Clock
HSYNC
Horizontal Sync Input
3.3 V CMOS
79
Analog
VSYNC
Vertical Sync Input
3.3 V CMOS
80
Analog
SOGIN
Input for Sync-on-Green
0.0 V to 1.0 V
64
Analog
Sync Outputs
HSOUT
HSYNC Output Clock (Phase-Aligned with
DATACK)
3.3 V CMOS
88
Both
VSOUT
VSYNC Output Clock
3.3 V CMOS
87
Both
SOGOUT
Sync-on-Green Slicer Output
3.3 V CMOS
89
Analog
References
REFBYPASS
Internal Reference Bypass
1.25 V
73
Analog
MIDBYPASS
Internal Midscale Voltage Bypass
74
Analog
PLL Filter
FILT
Connection for External Filter Components for
Internal PLL
48
Analog
Power Supply
VD
Analog Power Supply
3.15 V to 3.45 V
Both
VDD
Output Power Supply
2.2 V to 3.6 V
Both
PVD
PLL Power Supply
3.15 V to 3.45 V
Both
GND
Ground
0 V
Both
Serial Port Control
SDA
Serial Port Data I/O
3.3 V CMOS
78
Both
SCL
Serial Port Data Clock (100 kHz Maximum)
3.3 V CMOS
77
Both
A0
Serial Port Address Input
3.3 V CMOS
76
Both
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参数描述 |
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