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参数资料
| 型号： | ADSP-BF561SKBCZ-6V |
| 厂商： | Analog Devices Inc |
| 文件页数： | 26/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 600MHZ 256CSPBGA |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | SPI，SSP，UART |
| 时钟速率： | 600MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 328kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.35V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LFBGA，CSPBGA |
| 供应商设备封装： | 256-CSPBGA（12x12） |
| 包装： | 托盘 |
| 配用： | ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN ADZS-BF561-EZLITE-ND - BOARD EVAL ADSP-BF561 ADZS-BF561-MMSKIT-ND - KIT STARTER MULTIMEDIA BF561 ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT |
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ADSP-BF561
SDRAM Interface Timing
Table 20. SDRAM Interface Timing
Parameter
Min
Max
Unit
Timing Requirement s
t SSDAT
t HSDAT
DATA Setup Before CLKOUT
DATA Hold After CLKOUT
1.5
0.8
ns
ns
Switching Characteristics
t DCAD
t HCAD
t DSDAT
t ENSDAT
t SCLK
t SCLKH
t SCLKL
Command, ADDR, Data Delay After CLKOUT 1
Command, ADDR, Data Hold After CLKOUT 1
Data Disable After CLKOUT
Data Enable After CLKOUT
CLKOUT Period
CLKOUT Width High
CLKOUT Width Low
0.8
1.0
7.5
2.5
2.5
4.0
4.0
ns
ns
ns
ns
ns
ns
ns
1
Command pins include: SRAS, SCAS, SWE, SDQM, SMS3–0, SA10, SCKE.
SDCLK
t SDCLK
t SDCLKH
DATA (IN)
t SSDAT
t HSDAT
t ENSDAT
t DCAD
t SDCLKL
t DSDAT
t HCAD
DATA (OUT)
t DCAD
CMND ADDR
(OUT)
t HCAD
Figure 12. SDRAM Interface Timing
Rev. E |
Page 26 of 64 |
September 2009
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PDF描述 |
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| ADSP-BF561SKBZ500 | 制造商:Analog Devices 功能描述:Digital Signal Processor IC |
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