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参数资料
| 型号： | ADSP-BF561SKBCZ-6V |
| 厂商： | Analog Devices Inc |
| 文件页数： | 51/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 600MHZ 256CSPBGA |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | SPI，SSP，UART |
| 时钟速率： | 600MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 328kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.35V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LFBGA，CSPBGA |
| 供应商设备封装： | 256-CSPBGA（12x12） |
| 包装： | 托盘 |
| 配用： | ADZS-BFAUDIO-EZEXT-ND - BOARD EVAL AUDIO BLACKFIN ADZS-BF561-EZLITE-ND - BOARD EVAL ADSP-BF561 ADZS-BF561-MMSKIT-ND - KIT STARTER MULTIMEDIA BF561 ADZS-BFAV-EZEXT-ND - BOARD DAUGHT ADSP-BF533,37,61KIT |
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ADSP-BF561
256-BALL CSP_BGA (12 mm) BALL ASSIGNMENT
assignment by ball number. Table 38 on Page 53 lists the ball
assignment alphabetically by signal.
Table 37. 256-Ball CSP_BGA (12 mm × 12 mm) Ball Assignment (Numerically by Ball Number)
Ball No.
A01
A02
A03
A04
A05
A06
A07
A08
A09
A10
A11
A12
A13
A14
A15
A16
B01
B02
B03
B04
B05
B06
B07
B08
B09
B10
B11
B12
B13
B14
B15
B16
C01
C02
C03
C04
C05
C06
C07
C08
Signal
VDDEXT
ADDR24
ADDR20
VDDEXT
ADDR14
ADDR10
AMS3
AWE
VDDEXT
SMS3
SCLK0
SCLK1
BG
ABE2
ABE3
VDDEXT
PPI1CLK
ADDR22
ADDR18
ADDR16
ADDR12
VDDEXT
AMS1
ARE
SMS1
SCKE
VDDEXT
BR
ABE1
ADDR06
ADDR04
DATA0
PPI0SYNC2
PPI0CLK
ADDR25
ADDR19
GND
ADDR11
AOE
AMS0
Ball No.
C09
C10
C11
C12
C13
C14
C15
C16
D01
D02
D03
D04
D05
D06
D07
D08
D09
D10
D11
D12
D13
D14
D15
D16
E01
E02
E03
E04
E05
E06
E07
E08
E09
E10
E11
E12
E13
E14
E15
E16
Signal
SMS2
SRAS
GND
BGH
GND
ADDR07
DATA1
DATA3
PPI0D13
PPI0D15
PPI0SYNC3
ADDR23
GND
GND
ADDR09
GND
ARDY
SCAS
SA10
VDDEXT
ADDR02
GND
DATA5
DATA6
GND
PPI0D11
PPI0D12
PPI0SYNC1
ADDR15
ADDR13
AMS2
VDDINT
SMS0
SWE
ABE0
DATA2
GND
DATA4
DATA7
VDDEXT
Ball No.
F01
F02
F03
F04
F05
F06
F07
F08
F09
F10
F11
F12
F13
F14
F15
F16
G01
G02
G03
G04
G05
G06
G07
G08
G09
G10
G11
G12
G13
G14
G15
G16
H01
H02
H03
H04
H05
H06
H07
H08
Signal
CLKIN
VDDEXT
RESET
PPI0D10
ADDR21
ADDR17
VDDINT
GND
VDDINT
GND
ADDR08
DATA10
DATA8
DATA12
DATA9
DATA11
XTAL
GND
VDDEXT
BYPASS
PPI0D14
GND
GND
GND
VDDINT
ADDR05
ADDR03
DATA15
DATA14
GND
DATA13
VDDEXT
GND
GND
PPI0D9
PPI0D7
PPI0D5
VDDINT
VDDINT
GND
Ball No.
H09
H10
H11
H12
H13
H14
H15
H16
J01
J02
J03
J04
J05
J06
J07
J08
J09
J10
J11
J12
J13
J14
J15
J16
K01
K02
K03
K04
K05
K06
K07
K08
K09
K10
K11
K12
K13
K14
K15
K16
Signal
GND
GND
VDDINT
DATA16
DATA18
DATA20
DATA17
DATA19
VROUT0
VROUT1
PPI0D2
PPI0D3
PPI0D1
VDDEXT
GND
VDDINT
VDDINT
VDDINT
GND
DATA30
DATA22
GND
DATA21
DATA23
PPI0D6
PPI0D4
PPI0D8
PPI1SYNC1
PPI1D14
VDDEXT
GND
VDDINT
GND
GND
VDDINT
DATA28
DATA26
DATA24
DATA25
VDDEXT
Ball No.
L01
L02
L03
L04
L05
L06
L07
L08
L09
L10
L11
L12
L13
L14
L15
L16
M01
M02
M03
M04
M05
M06
M07
M08
M09
M10
M11
M12
M13
M14
M15
M16
N01
N02
N03
N04
N05
N06
N07
N08
Signal
PPI0D0
PPI1SYNC2
GND
PPI1SYNC3
VDDEXT
PPI1D11
GND
VDDINT
GND
VDDEXT
GND
DR0PRI
TFS0
GND
DATA27
DATA29
PPI1D15
PPI1D13
PPI1D9
GND
NC
PF3
PF7
VDDINT
GND
BMODE0
SCK
DR1PRI
NC
VDDEXT
DATA31
DT0PRI
PPI1D12
PPI1D10
PPI1D3
PPI1D1
PF1
PF9
GND
PF13
Rev. E |
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September 2009
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参数描述 |
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