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参数资料
| 型号： | EP2C20F256I6N |
| 厂商： | ALTERA CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1196 CLBS, PBGA256 |
| 封装： | LEAD FREE, FBGA-256 |
| 文件页数： | 110/168页 |
| 文件大小： | 2206K |
| 代理商： | EP2C20F256I6N |
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2–34
Altera Corporation
Cyclone II Device Handbook, Volume 1
February 2007
Embedded Multipliers
Figure 2–18. Multiplier Block Architecture
Note to Figure 2–18:
(1)
If necessary, these signals can be registered once to match the data signal path.
Each multiplier operand can be a unique signed or unsigned number.
Two signals, signa and signb, control the representation of each
operand respectively. A logic 1 value on the signa signal indicates that
data A is a signed number while a logic 0 value indicates an unsigned
number. Table 2–11 shows the sign of the multiplication result for the
various operand sign representations. The result of the multiplication is
signed if any one of the operands is a signed value.
CLRN
DQ
ENA
Data A
Data B
aclr
clock
ena
signa (1)
signb (1)
CLRN
DQ
ENA
CLRN
DQ
ENA
Data Out
Embedded Multiplier Block
Output
Register
Input
Register
Table 2–11. Multiplier Sign Representation
Data A (signa Value)
Data B (signb Value)
Result
Unsigned
Signed
Unsigned
Signed
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PDF描述 |
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