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参数资料
| 型号： | EP2C20F256I6N |
| 厂商： | ALTERA CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1196 CLBS, PBGA256 |
| 封装： | LEAD FREE, FBGA-256 |
| 文件页数： | 117/168页 |
| 文件大小： | 2206K |
| 代理商： | EP2C20F256I6N |
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2–40
Altera Corporation
Cyclone II Device Handbook, Volume 1
February 2007
I/O Structure & Features
Figure 2–22. Column I/O Block Connection to the Interconnect
Notes to Figure 2–22:
(1)
The 28 data and control signals consist of four data out lines, io_dataout[3..0], four output enables,
io_coe[3..0]
, four input clock enables, io_cce_in[3..0], four output clock enables, io_cce_out[3..0],
four clocks, io_cclk[3..0], four asynchronous clear signals, io_caclr[3..0], and four synchronous clear
signals, io_csclr[3..0].
(2)
Each of the four IOEs in the column I/O block can have two io_datain (combinational or registered) inputs.
28 Data &
Control Signals
from Logic Array (1)
Column I/O
Block Contains
up to Four IOEs
I/O Block
Local Interconnect
io_datain0[3..0]
io_datain1[3..0] (2)
R4 & R24 Interconnects
LAB Local
Interconnect
C4 & C24 Interconnects
28
LAB
io_clk[5..0]
Column I/O Block
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PDF描述 |
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