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参数资料
| 型号： | EP2C20F256I6N |
| 厂商： | ALTERA CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1196 CLBS, PBGA256 |
| 封装： | LEAD FREE, FBGA-256 |
| 文件页数： | 44/168页 |
| 文件大小： | 2206K |
| 代理商： | EP2C20F256I6N |
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5–48
Altera Corporation
Cyclone II Device Handbook, Volume 1
February 2008
Timing Specifications
DIFFERENTIAL_SSTL_18_
CLASS_I
500
DIFFERENTIAL_SSTL_18_
CLASS_II
500
1.8V_DIFFERENTIAL_HSTL_
CLASS_I
500
1.8V_DIFFERENTIAL_HSTL_
CLASS_II
500
1.5V_DIFFERENTIAL_HSTL_
CLASS_I
500
1.5V_DIFFERENTIAL_HSTL_
CLASS_II
500
LVPECL
—
402
LVDS
402
1.2V_HSTL
110
90
80
—
110
90
80
1.2V_DIFFERENTIAL_HSTL
110
90
80
—
110
90
80
Table 5–45. Maximum Output Clock Toggle Rate on Cyclone II Devices (Part 1 of 4)
I/O Standard
Drive
Strength
Maximum Output Clock Toggle Rate on Cyclone II Devices (MHz)
Column I/O Pins (1)
Row I/O Pins (1)
Dedicated Clock
Outputs
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
LVTTL
4 mA
120
100
80
120
100
80
120
100
80
8 mA
200
170
140
200
170
140
200
170
140
12 mA
280
230
190
280
230
190
280
230
190
16 mA
290
240
200
290
240
200
290
240
200
20 mA
330
280
230
330
280
230
330
280
230
24 mA
360
300
250
360
300
250
360
300
250
Table 5–44. Maximum Input Clock Toggle Rate on Cyclone II Devices (Part 2 of 2)
I/O Standard
Maximum Input Clock Toggle Rate on Cyclone II Devices (MHz)
Column I/O Pins
Row I/O Pins
Dedicated Clock
Inputs
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
–6
Speed
Grade
–7
Speed
Grade
–8
Speed
Grade
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PDF描述 |
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