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参数资料
| 型号： | HW-SPAR3AN-SK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 54/140页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER SPARTAN-3 AN |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3AN |
| 类型： | FPGA |
| 适用于相关产品： | Spartan-3AN XC3S700AN-FG484，XCF04S-VOG20C |
| 所含物品： | 面板、缆线、软件、数据表和用户手册 |
| 相关产品： | XC3S700AN-5FGG484C-ND - IC FPGA SPARTAN-3A 700K 484-FBGA 122-1598-ND - IC FPGA SPARTAN -3AN700K 484FBGA 122-1556-ND - IC SPARTAN-3AN FPGA 700K 484FBGA |
| 其它名称： | 122-1528 HW-SPAR3AN-SK-UNI-G-PROMO HW-SPAR3AN-SK-UNI-G-PROMO-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页当前第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页
Chapter 5: Character LCD Screen
Power-On Initialization
The initialization sequence first establishes that the FPGA application wishes to use the
four-bit data interface to the LCD as follows:
R
1.
2.
3.
4.
5.
6.
7.
8.
9.
Wait 15 ms or longer, although the display is generally ready when the FPGA finishes
configuration. The 15 ms interval is 750,000 clock cycles at 50 MHz.
Write LCD_DB<7:4> = 0x3, and pulse LCD_E High for 12 clock cycles.
Wait 4.1 ms or longer, which is 205,000 clock cycles at 50 MHz.
Write LCD_DB<7:4> = 0x3, and pulse LCD_E High for 12 clock cycles.
Wait 100 μ s or longer, which is 5,000 clock cycles at 50 MHz.
Write LCD_DB<7:4> = 0x3, and pulse LCD_E High for 12 clock cycles.
Wait 40 μ s or longer, which is 2,000 clock cycles at 50 MHz.
Write LCD_DB<7:4> = 0x2, and pulse LCD_E High for 12 clock cycles.
Wait 40 μ s or longer, which is 2,000 clock cycles at 50 MHz.
Display Configuration
After the power-on initialization is completed, the four-bit interface is established. The
next part of the sequence configures the display:
1.
2.
3.
4.
Issue a Function Set command, 0x28, to configure the display for operation on the
Spartan-3A/3AN Starter Kit board.
Issue an Entry Mode Set command, 0x06, to set the display to automatically increment
the address pointer.
Issue a Display On/Off command, 0x0C to turn the display on and disable the cursor
and blinking.
Finally, issue a Clear Display command. Allow at least 1.64 ms (82,000 clock cycles)
after issuing this command.
Writing Data to the Display
To write data to the display, specify the start address, followed by one or more data values.
Before writing any data, issue a Set DD RAM Address command to specify the initial
seven-bit address in the DD RAM. See Figure 5-3 for DD RAM locations.
Write data to the display using a Write Data to CG RAM or DD RAM command. The eight-
bit data value represents the look-up address into the CG ROM or CG RAM, shown in
Figure 5-4 . The stored bitmap in the CG ROM or CG RAM drives the 5 x 8 dot matrix to
represent the associated character.
If the address counter is configured to auto-increment, as described earlier, the application
can sequentially write multiple character codes, and each character is automatically stored
and displayed in the next available location.
Continuing to write characters, however, eventually falls off the end of the first display
line. The additional characters do not automatically appear on the second line because the
DD RAM map is not consecutive from the first line to the second.
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www.xilinx.com Spartan-3A/3AN FPGA Starter Kit Board User Guide
UG334 (v1.1) June 19, 2008
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