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参数资料
| 型号： | HW-SPAR3AN-SK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 95/140页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER SPARTAN-3 AN |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3AN |
| 类型： | FPGA |
| 适用于相关产品： | Spartan-3AN XC3S700AN-FG484，XCF04S-VOG20C |
| 所含物品： | 面板、缆线、软件、数据表和用户手册 |
| 相关产品： | XC3S700AN-5FGG484C-ND - IC FPGA SPARTAN-3A 700K 484-FBGA 122-1598-ND - IC FPGA SPARTAN -3AN700K 484FBGA 122-1556-ND - IC SPARTAN-3AN FPGA 700K 484FBGA |
| 其它名称： | 122-1528 HW-SPAR3AN-SK-UNI-G-PROMO HW-SPAR3AN-SK-UNI-G-PROMO-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页当前第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页
R
UCF Location Constraints
UCF Location Constraints
Figure 12-3 provides the UCF constraints for the SPI serial Flash PROM, including the I/O
pin assignment and the I/O standard used.
# some connections shared with
SPI Flash,
DAC, ADC, and AMP
NET "SPI_MISO"
LOC = "AB20" |
IOSTANDARD
= LVCMOS33 ;
NET "SPI_MOSI"
NET "SPI_SCK"
NET "SPI_SS_B"
NET "ALT_SS_B"
LOC = "AB14" |
LOC = "AA20" |
LOC = "Y4" |
LOC = "Y5" |
IOSTANDARD
IOSTANDARD
IOSTANDARD
IOSTANDARD
= LVCMOS33 | SLEW
= LVCMOS33 | SLEW
= LVCMOS33 | SLEW
= LVCMOS33 | SLEW
=
=
=
=
SLOW
SLOW
SLOW
SLOW
|
|
|
|
DRIVE
DRIVE
DRIVE
DRIVE
=
=
=
=
8
8
8
8
;
;
;
;
# write-protect and reset controls for Atmel AT45DB161D PROM
NET "DATAFLASH_WP"
NET "DATAFLASH_RST"
LOC = "C14" | IOSTANDARD = LVCMOS33 | SLEW = SLOW | DRIVE = 8 ;
LOC = "C15" | IOSTANDARD = LVCMOS33 | SLEW = SLOW | DRIVE = 8 ;
# write-protect control for ST M25P16 PROM
NET "ST_SPI_WP"
Figure 12-3:
LOC = "C13" | IOSTANDARD = LVCMOS33 | SLEW = SLOW | DRIVE = 8 ;
UCF Location Constraints for SPI Flash Connections
Creating and Programming Configuration Images for SPI Serial
Flash
Refer to the “ Master SPI Mode ” chapter in the Spartan-3 Generation Configuration User Guide
for information on how to create and format FPGA configuration images for SPI serial
Flash and how to program SPI Flash using the Xilinx iMPACT software.
?
UG332: Spartan-3 Generation Configuration User Guide
SPI Flash PROM Programming Options
Starting with ISE ? 9.1i, Service Pack 2 and later, the iMPACT programming software
supports two different methods to program an attached SPI Flash PROM, as summarized
Using the Direct Programming Method , the programming cable communicates directly to
the SPI Flash PROM. The FPGA is not involved in the programming process and the FPGA
I/O pins that connect to the PROM must be in their high-impedance state (Hi-Z) during
programming. Hold the FPGA’s PROG_B input Low using jumper J16 to place the I/Os in
Hi-Z; the FPGA’s DONE pin remains Low.
Using the Indirect Programming Method , the programming cable connects to the FPGA’s
JTAG port. The iMPACT software first programs the FPGA with a special design that
performs the SPI PROM programming and uses the JTAG interface as a serial
communications port. During the process, the FPGA’s DONE output is High and the
DONE LED is lit because the FPGA is configured with the programming logic. All pins
that are not connected to the SPI Flash PROM or the JTAG interface have an internal
pull-up resistor to the V CCO voltage supply associated with the pin.
Spartan-3A/3AN FPGA Starter Kit Board User Guide www.xilinx.com
UG334 (v1.1) June 19, 2008
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