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参数资料
| 型号： | HW-SPAR3AN-SK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 74/140页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER SPARTAN-3 AN |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3AN |
| 类型： | FPGA |
| 适用于相关产品： | Spartan-3AN XC3S700AN-FG484，XCF04S-VOG20C |
| 所含物品： | 面板、缆线、软件、数据表和用户手册 |
| 相关产品： | XC3S700AN-5FGG484C-ND - IC FPGA SPARTAN-3A 700K 484-FBGA 122-1598-ND - IC FPGA SPARTAN -3AN700K 484FBGA 122-1556-ND - IC SPARTAN-3AN FPGA 700K 484FBGA |
| 其它名称： | 122-1528 HW-SPAR3AN-SK-UNI-G-PROMO HW-SPAR3AN-SK-UNI-G-PROMO-ND |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页当前第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页
Chapter 9: Analog Capture Circuit
Table 9-2:
Programmable Gain Settings for Pre-Amplifier (Continued)
R
Gain
A3
B3
A2
B2
A1
B1
A0
B0
Input Voltage Range
Minimum Maximum
-5
-10
-20
-50
-100
0
0
0
0
0
0
1
1
1
1
1
0
0
1
1
1
0
1
0
1
1.4
1.525
1.5875
1.625
1.6375
1.9
1.775
1.7125
1.675
1.6625
SPI Control Interface
Figure 9-3 highlights the SPI-based communications interface with the amplifier. The gain
for each amplifier is sent as an eight-bit command word, consisting of two four-bit fields.
The most-significant bit, B3, is sent first.
AMP_DOUT
0
Slave: LTC2624-1
7
SPI_MOSI
A 0 A 1 A 2 A 3 B 0 B 1 B 2 B 3
FPGA
AMP_CS
Master
SPI_SCK
A Gain
B Gain
UG334_c9_03_052407
Figure 9-3:
SPI Serial Interface to Amplifier
The AMP_DOUT output from the amplifier echoes the previous gain settings. These
values can be ignored for most applications.
The SPI bus transaction starts when the FPGA asserts AMP_CS Low (see Figure 9-4 ). The
amplifier captures serial data on SPI_MOSI on the rising edge of the SPI_SCK clock signal.
The amplifier presents serial data on AMP_DOUT on the falling edge of SPI_SCK.
AMP_CS
SPI_SCK
30
30
50
50
SPI_MOSI
7
6
5
4
3
2
(from FPGA)
85 max
AMP_DOUT
Previous 7
6
5
4
3
2
(from AMP)
All timing is minimum in nanoseconds unless otherwise noted.
UG230_c10_04_022306
Figure 9-4: SPI Timing When Communicating with Amplifier
The amplifier interface is relatively slow, supporting only about a 10 MHz clock frequency.
74
www.xilinx.com Spartan-3A/3AN FPGA Starter Kit Board User Guide
UG334 (v1.1) June 19, 2008
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