参数资料
| 型号： | IPS-VIDEO |
| 厂商： | Altera |
| 文件页数： | 158/290页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO/IMAGE PROCESSING SUITE |
| 标准包装： | 1 |
| 系列： | * |
| 功能： | 视频和图像处理用 IP 功能套件 |
| 许可证： | 初始许可证 |
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16–14
Chapter 16: Deinterlacer MegaCore Function
Signals
Table 16–4. Deinterlacer Signals (Part 3 of 4)
Signal
read_master_N_av_address
read_master_N_av_burstcount
read_master_N_av_clock
read_master_N_av_read
read_master_N_av_readdata
read_master_N_av_readdatavalid
read_master_N_av_reset
read_master_N_av_waitrequest
write_master_av_address
write_master_av_burstcount
write_master_av_clock
write_master_av_reset
write_master_av_waitrequest
write_master_av_write
Video and Image Processing Suite
User Guide
Direction
Out
Out
In
Out
In
In
In
In
Out
Out
In
In
In
Out
Description
read_master_N port Avalon-MM address bus. This bus
specifies a byte address in the Avalon-MM address space.
read_master_N port Avalon-MM burstcount signal. This
read_master_N port clock signal. The interface operates
on the rising edge of the clock signal. (1) , (2) , (3) , (4)
read_master_N port Avalon-MM read signal. The
MegaCore function asserts this signal to indicate read
requests from the master to the system interconnect fabric.
read_master_N port Avalon-MM readdata bus. These
input lines carry data for read transfers. (1) , (2) , (3)
read_master_N port Avalon-MM readdatavalid signal.
The system interconnect fabric asserts this signal when the
requested read data has arrived. (1) , (2) , (3)
read_master_N port reset signal.
The interface asynchronously resets when this signal is
high. You must deassert this signal synchronously to the
rising edge of the clock signal. (1) , (2) , (3) , (4)
read_master_N port Avalon-MM waitrequest signal.
The system interconnect fabric asserts this signal to cause
the master port to wait. (1) , (2) , (3)
write_master port Avalon-MM address bus. This bus
specifies a byte address in the Avalon-MM address space.
write_master port Avalon-MM burstcount signal. This
write_master port clock signal. The interface operates on
the rising edge of the clock signal. (1) , (3) , (4)
write_master port reset signal. The interface
asynchronously resets when this signal is high. You must
deassert this signal synchronously to the rising edge of the
clock signal. (1) , (3) , (4)
write_master port Avalon-MM waitrequest signal. The
system interconnect fabric asserts this signal to cause the
master port to wait. (1) , (3)
write_master port Avalon-MM write signal. The
MegaCore function asserts this signal to indicate write
requests from the master to the system interconnect fabric.
February 2014 Altera Corporation
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参数描述 |
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