参数资料
| 型号： | IPS-VIDEO |
| 厂商： | Altera |
| 文件页数： | 163/290页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO/IMAGE PROCESSING SUITE |
| 标准包装： | 1 |
| 系列： | * |
| 功能： | 视频和图像处理用 IP 功能套件 |
| 许可证： | 初始许可证 |
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Chapter 17: Deinterlacer II MegaCore Function
17–3
Functional Description
Figure 17–2. Deinterlacer II Block Diagram
Avalon-ST Input
(din)
Memory
Memory
Deinterlacing
Writer
Reader
Algorithm
Avalon-ST Output
(dout)
Avalon-MM Master
(write_master)
Avalon-MM Master
(read_master)
Arbitration Logic
DDR2
SDRAM
(1) There can be one or two Avalon-MM masters connected to the Memory Reader.
This buffering method provides the following features:
■
■
■
The Deinterlacer II has a latency of only a few of lines, compared to the
Deinterlacer that has a latency of a field.
The Deinterlacer II requires less memory bandwidth. In normal operating mode,
the Deinterlacer II writes incoming input fields into the memory and only fetches
the three preceding fields to build the progressive output frame. The simple
motion-adaptive algorithm in the Deinterlacer requires four fields to build the
progressive output frame. Additionally, the Deinterlacer II does not use external
memory when propagating progressive frames.
The Deinterlacer II does not provide double and triple-buffering, and does not
support the user-defined frame rate conversion feature offered in the Deinterlacer.
1
You may face throughput issues when you swap the Deinterlacer with the
Deinterlacer II in your designs. You can easily fix the throughput issues by
instantiating the Frame Buffer MegaCore Function into the designs.
■
■
The Deinterlacer II only allows one output frame for one input field. The
Deinterlacer II uses each interlaced field to construct a deinterlaced frame, which
effectively doubles the frame rate.
The Deinterlacer II does not store the Avalon-ST video user packets in the
memory, and directly propagates the user packets to the output. However, it does
not propagate the receive control packets. The Deinterlacer II builds and sends a
new control packet before each output frame.
The Deinterlacer II gives you the option to detect both 3:2 and 2:2 cadences in the
input video sequence and perform a reverse telecine operation for perfect restoration
of the original progressive content. You can switch off the cadence detector at run time
when you enable the slave interface.
February 2014
Altera Corporation
Video and Image Processing Suite
User Guide
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参数描述 |
|---|---|
| IPS-WMD | 功能描述:IP WIRELESS MOD/DEMOD SUITE RoHS:否 类别:编程器，开发系统 >> 软件 系列:* 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
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