参数资料
| 型号： | IPS-VIDEO |
| 厂商： | Altera |
| 文件页数： | 225/290页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO/IMAGE PROCESSING SUITE |
| 标准包装： | 1 |
| 系列： | * |
| 功能： | 视频和图像处理用 IP 功能套件 |
| 许可证： | 初始许可证 |
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23–14
Chapter 23: Scaler II MegaCore Function
Control Register Maps
Table 23–3. Scaler II Signals (Part 2 of 2)
Signal
din_endofpacket
din_ready
din_startofpacket
din_valid
dout_data
dout_endofpacket
dout_ready
dout_startofpacket
dout_valid
Direction
In
Out
In
In
Out
Out
In
Out
Out
Description
din port Avalon-ST endofpacket signal. This signal marks the end of an
Avalon-ST packet.
din port Avalon-ST ready signal. This signal indicates when the MegaCore
function is ready to receive data.
din port Avalon-ST startofpacket signal. This signal marks the start of
an Avalon-ST packet.
din port Avalon-ST valid signal. This signal identifies the cycles when the
port must input data.
dout port Avalon-ST data bus. This bus enables the transfer of pixel data
out of the MegaCore function.
dout port Avalon-ST endofpacket signal. This signal marks the end of an
Avalon-ST packet.
dout port Avalon-ST ready signal. The downstream device asserts this
signal when it is able to receive data.
dout port Avalon-ST startofpacket signal. This signal marks the start of
an Avalon-ST packet.
dout port Avalon-ST valid signal. This signal is asserted when the
MegaCore function outputs data.
(1) These ports are not present if you turn off Enable r un-time cont r ol of input/output f r ame size and select Bilinea r for Scaling algo r ithm in the
parameter editor.
Control Register Maps
run-time control register map for the Scaler II MegaCore function is altered and does
not match the register map of the Scaler MegaCore function.
1
The N taps is the number of horizontal or vertical filter taps, whichever is larger.
The Scaler II reads the control data once at the start of each frame and buffers the data
inside the MegaCore function. The registers may be safely updated during the
processing of a frame, unless the frame is a coefficient bank.
The coefficient bank that is being read by the Scaler II must not be written to unless
the core is in a stopped state. To change the contents of the coefficient bank while the
Scaler II is in a running state, you must use multiple coefficient banks to allow an
inactive bank to be changed without affecting the frame currently being processed.
The Scaler II allows for dynamic bus sizing on the slave interface. The slave interface
includes a 4-bit byte enable signal, and the width of the data on the slave interface is
32 bits.
Video and Image Processing Suite
User Guide
February 2014 Altera Corporation
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