参数资料
| 型号： | IPS-VIDEO |
| 厂商： | Altera |
| 文件页数： | 25/290页 |
| 文件大小： | 0K |
| 描述： | IP VIDEO/IMAGE PROCESSING SUITE |
| 标准包装： | 1 |
| 系列： | * |
| 功能： | 视频和图像处理用 IP 功能套件 |
| 许可证： | 初始许可证 |
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Chapter 1: About This MegaCore Function Suite
Performance and Resource Utilization
1–15
1
The Scaler II instances line buffers with default, non-depth stitched block memories. If
your design requires depth stitching to achieve greater block memory density, refer to
the Quartus II Software Handbook to manually set the MAXIMUM_DEPTH parameter.
For example, set MAXIMUM_DEPTH 1024 to
QsysTop:inst|QsysTop_Full_Scaler_0:full_scaler_0|alt_vip_line_buffer:line_
buffer|alt_vip_line_buffer_mem_block:actual_line_buffers|altsyncram:main_m
em.
Switch
Table 1–22. Switch Performance
Device Family
Combinational
LUTs/ALUTs
Logic
Registers
Bits
Memory
M9K
M20K
DSP Blocks
(9×9) (18×18)
f MAX
(MHz)
2 input, 2 output switch with alpha channels disabled and doing three colors in sequence.
Cyclone IV GX (1)
122
155
—
0
—
—
—
328.95
Stratix
V (2)
80
127
—
—
0
—
—
527.43
12 input, 12 output switch with alpha channels enabled and doing three colors in parallel.
Cyclone IV GX (1)
6,177
6,884
—
0
—
—
—
165.34
Stratix
V (2)
4,553
2,547
—
—
0
—
—
231.70
(1) EP4CGX15BF14C6 devices.
(2) 5SGXEA7H3F35C3 devices.
Test Pattern Generator
Table 1–23. Test Pattern Generator Performance (Part 1 of 2)
Device Family
Combinational
LUTs/ALUTs
Logic
Registers
Bits
Memory
M9K
M20K
DSP Blocks
(9×9) (18×18)
f MAX
(MHz)
Producing a 400×x200, 8-bit 4:2:0 Y'Cb'Cr' stream with a parallel data interface.
Cyclone IV GX (1)
159
168
192
2
—
—
—
315.06
Stratix
V (2)
152
115
192
—
2
—
—
500.00
Producing a 640×480, 8-bit R'G'B' stream with a sequential data interface.
Cyclone IV GX (1)
214
217
192
3
—
—
—
315.06
Stratix
V (2)
161
117
192
—
3
—
—
490.44
Producing a 720×480, 10-bit 4:2:2 Y'Cb'Cr' interlaced stream with a sequential data interface.
Cyclone IV GX (1)
Stratix V (2)
261
240
263
135
240
240
3
—
—
3
—
—
—
—
252.33
482.39
Producing a 1920×1080, 10-bit 4:2:2 Y'Cb'Cr' interlaced stream with a parallel data interface. The resolution of the pattern
can be changed using the run-time control interface.
Cyclone IV GX (1)
338
370
304
4
—
—
—
262.12
February 2014
Altera Corporation
Video and Image Processing Suite
User Guide
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PDF描述 |
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参数描述 |
|---|---|
| IPS-WMD | 功能描述:IP WIRELESS MOD/DEMOD SUITE RoHS:否 类别:编程器，开发系统 >> 软件 系列:* 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
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