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参数资料
型号： LFXP2-17E-7F484C
厂商： LATTICE SEMICONDUCTOR CORP
元件分类： FPGA
中文描述： FPGA, 420 MHz, PBGA484
封装： 23 X 23 MM, FPBGA-484
文件页数： 47/92页
文件大小： 1701K
代理商： LFXP2-17E-7F484C
3-7
DC and Switching Characteristics
Lattice Semiconductor
LatticeXP2 Family Data Sheet
sysIO Single-Ended DC Electrical Characteristics
Over Recommended Operating Conditions
Input/Output
Standard
VIL
VIH
VOL
VOH
IOL
1 (mA)
IOH
1 (mA)
Min. (V)
Max. (V)
Min. (V)
Max. (V)
Min. (V)
LVCMOS33
-0.3
0.8
2.0
3.6
0.4
VCCIO - 0.4
20, 16,
12, 8, 4
-20, -16,
-12, -8, -4
0.2
VCCIO - 0.2
0.1
-0.1
LVTTL33
-0.3
0.8
2.0
3.6
0.4
VCCIO - 0.4
20, 16,
12, 8, 4
-20, -16,
-12, -8, -4
0.2
VCCIO - 0.2
0.1
-0.1
LVCMOS25
-0.3
0.7
1.7
3.6
0.4
VCCIO - 0.4
20, 16,
12, 8, 4
-20, -16,
-12, -8, -4
0.2
VCCIO - 0.2
0.1
-0.1
LVCMOS18
-0.3
0.35 VCCIO
0.65 VCCIO
3.6
0.4
VCCIO - 0.4
16, 12,
8, 4
-16, -12,
-8, -4
0.2
VCCIO - 0.2
0.1
-0.1
LVCMOS15
-0.3
0.35 VCCIO
0.65 VCCIO
3.6
0.4
VCCIO - 0.4
8, 4
-8, -4
0.2
VCCIO - 0.2
0.1
-0.1
LVCMOS12
-0.3
0.35 VCC
0.65 VCC
3.6
0.4
VCCIO - 0.4
6, 2
-6, -2
0.2
VCCIO - 0.2
0.1
-0.1
PCI33
-0.3
0.3 VCCIO
0.5 VCCIO
3.6
0.1 VCCIO 0.9 VCCIO
1.5
-0.5
SSTL33_I
-0.3
VREF - 0.2
VREF + 0.2
3.6
0.7
VCCIO - 1.1
8
-8
SSTL33_II
-0.3
VREF - 0.2
VREF + 0.2
3.6
0.5
VCCIO - 0.9
16
-16
SSTL25_I
-0.3
VREF - 0.18
VREF + 0.18
3.6
0.54
VCCIO - 0.62
7.6
-7.6
12
-12
SSTL25_II
-0.3
VREF - 0.18
VREF + 0.18
3.6
0.35
VCCIO - 0.43
15.2
-15.2
20
-20
SSTL18_I
-0.3
VREF - 0.125 VREF + 0.125
3.6
0.4
VCCIO - 0.4
6.7
-6.7
SSTL18_II
-0.3
VREF - 0.125 VREF + 0.125
3.6
0.28
VCCIO - 0.28
8-8
11
-11
HSTL15_I
-0.3
VREF - 0.1
VREF + 0.1
3.6
0.4
VCCIO - 0.4
4-4
8-8
HSTL18_I
-0.3
VREF - 0.1
VREF + 0.1
3.6
0.4
VCCIO - 0.4
8-8
12
-12
HSTL18_II
-0.3
VREF - 0.1
VREF + 0.1
3.6
0.4
VCCIO - 0.4
16
-16
1. The average DC current drawn by I/Os between GND connections, or between the last GND in an I/O bank and the end of an I/O bank, as
shown in the logic signal connections table shall not exceed n * 8mA, where n is the number of I/Os between bank GND connections or
between the last GND in a bank and the end of a bank.
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