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参数资料
型号： LFXP2-17E-7F484C
厂商： LATTICE SEMICONDUCTOR CORP
元件分类： FPGA
中文描述： FPGA, 420 MHz, PBGA484
封装： 23 X 23 MM, FPBGA-484
文件页数： 60/92页
文件大小： 1701K
代理商： LFXP2-17E-7F484C
3-19
DC and Switching Characteristics
Lattice Semiconductor
LatticeXP2 Family Data Sheet
LatticeXP2 Internal Switching Characteristics
1
Over Recommended Operating Conditions
Parameter
Description
-7
-6
-5
Units
Min.
Max.
Min.
Max.
Min.
Max.
PFU/PFF Logic Mode Timing
tLUT4_PFU
LUT4 delay (A to D inputs to F
output)
—
0.216
—
0.238
—
0.260
ns
tLUT6_PFU
LUT6 delay (A to D inputs to OFX
output)
—
0.304
—
0.399
—
0.494
ns
tLSR_PFU
Set/Reset to output of PFU (Asyn-
chronous)
—
0.720
—
0.769
—
0.818
ns
tSUM_PFU
Clock to Mux (M0,M1) Input
Setup Time
0.154
—
0.151
—
0.148
—
ns
tHM_PFU
Clock to Mux (M0,M1) Input Hold
Time
-0.061
—
-0.057
—
-0.053
—
ns
tSUD_PFU
Clock to D input setup time
0.061
—
0.077
—
0.093
—
ns
tHD_PFU
Clock to D input hold time
0.002
—
0.003
—
0.003
—
ns
tCK2Q_PFU
Clock to Q delay, (D-type Register
Configuration)
—
0.342
—
0.363
—
0.383
ns
tRSTREC_PFU
Asynchronous reset recovery
time for PFU Logic
—
0.520
—
0.634
—
0.748
ns
tRST_PFU
Asynchronous reset time for PFU
Logic
—
0.720
—
0.769
—
0.818
ns
PFU Dual Port Memory Mode Timing
tCORAM_PFU
Clock to Output (F Port)
—
1.082
—
1.267
—
1.452
ns
tSUDATA_PFU
Data Setup Time
-0.206
—
-0.240
—
-0.274
—
ns
tHDATA_PFU
Data Hold Time
0.239
—
0.275
—
0.312
—
ns
tSUADDR_PFU
Address Setup Time
-0.294
—
-0.333
—
-0.371
—
ns
tHADDR_PFU
Address Hold Time
0.295
—
0.333
—
0.371
—
ns
tSUWREN_PFU Write/Read Enable Setup Time
-0.146
—
-0.169
—
-0.193
—
ns
tHWREN_PFU
Write/Read Enable Hold Time
0.158
—
0.182
—
0.207
—
ns
PIO Input/Output Buffer Timing
tIN_PIO
Input Buffer Delay (LVCMOS25)
—
0.858
—
0.766
—
0.674
ns
tOUT_PIO
Output Buffer Delay (LVCMOS25)
—
1.561
—
1.403
—
1.246
ns
IOLOGIC Input/Output Timing
tSUI_PIO
Input Register Setup Time (Data
Before Clock)
0.583
—
0.893
—
1.201
—
ns
tHI_PIO
Input Register Hold Time (Data
after Clock)
0.062
—
0.322
—
0.482
—
ns
tCOO_PIO
Output Register Clock to Output
Delay
—
0.608
—
0.661
—
0.715
ns
tSUCE_PIO
Input Register Clock Enable
Setup Time
0.032
—
0.037
—
0.041
—
ns
tHCE_PIO
Input Register Clock Enable Hold
Time
-0.022
—
-0.025
—
-0.028
—
ns
tSULSR_PIO
Set/Reset Setup Time
0.184
—
0.201
—
0.217
—
ns
tHLSR_PIO
Set/Reset Hold Time
-0.080
—
-0.086
—
-0.093
—
ns
tRSTREC_PIO
Asynchronous reset recovery
time for IO Logic
0.228
—
0.247
—
0.266
—
ns
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PDF描述
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参数描述
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LFXP2-17E-7FN484C 功能描述:FPGA - 现场可编程门阵列 17KLUTs 358 I/O Inst -on DSP 1.2V -6 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
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LFXP2-17E-7FT256C 功能描述:FPGA - 现场可编程门阵列 17KLUTs 201 I/O Inst -on DSP 1.2V -7 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
LFXP2-17E-7FT256C8W 功能描述:FPGA - 现场可编程门阵列 17KLUTs 201 I/O Inst -on DSP 1.2V -7 Spd RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
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