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参数资料
| 型号： | PC34708VM |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 电源管理 |
| 英文描述： | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA206 |
| 封装： | 13 X 13 MM, 0.80 MM PITCH, LEAD FREE, MO-275HHAC-1, MAPBGA-206 |
| 文件页数： | 103/200页 |
| 文件大小： | 5160K |
| 代理商： | PC34708VM |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页当前第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
Analog Integrated Circuit Device Data
Freescale Semiconductor
191
PC34708
Typical Applications
PC34708 Layout Guidelines
8.2
PC34708 Layout Guidelines
8.2.1
General board recommendations
1. It is recommended to use an 8 layer board stack-up arranged as follows:
High current signal
GND
Signal
Power
Signal
GND
High current signal
2. Allocate TOP and BOTTOM PCB Layers for POWER ROUTING (high current signals), copper-pour the unused area.
3. Use internal layers sandwiched between two GND planes for the SIGNAL routing.
8.2.2
Component Placement
Sense resistors should be placed as Close to the IC as possible. Route the high current path flowing from VBATT to BATTISNSN
as thick and as short as possible to reduce power losses.
8.2.3
General Routing Requirements
1. Some recommended things to keep in mind for manufacturability:
Via in pads require a 4.5 mil Minimum annular ring. Pad must be 9.0 mils larger than the hole
Max copper thickness for lines less than 5.0 mils wide is 0.6 oz copper
Minimum allowed spacing between line and hole pad is 3.5 mils
Minimum allowed spacing between line and line is 3.0 mils
2. Care must be taken with SWxFB pins traces. These signals are susceptible to noise and must be routed far away from
power, clock, or high power signals, like the ones on the SWxIN, SWx, SWxLX, SWBSTIN, SWBST, and SWBSTLX pins.
3. Shield feedback traces of the switchers and keep them as short as possible (trace them on the bottom so the ground and
power planes shield these traces).
4. Sense pins must be directly connected to the 0.02 Ohm sense resistor R1 (BATTISNSN and BATTISNSP).
5. Avoid coupling trace between important signal/low noise supplies (like VREFCORE, VCORE, VCOREDIG) from any
switching node (i.e. SW1ALXx, SW2LXx, SW3LXx, SW4ALX, SW4BLX, SW5LXx, SWBSTLXx, and CHRGLXx).
6. Make sure that all components related to an specific block are referenced to the corresponding ground, e.g. all
components related to the SW1 converter must referenced to GNDSW1A1 and GNDSW1A2.
7. The LEDVDD trace must be orthogonal from the CHRGLXx traces.
8.2.4
Parallel Routing Requirements
1. SPI/I2S signal routing:
CLK is the fastest signal of the system, so it must be given special care. Here are some tips for routing the communication
signals:
To avoid contamination of these delicate signals by nearby high power or high frequency signals, it is a good practice to
shield them with ground planes placed on adjacent layers. Make sure the ground plane is uniform throughout the whole
signal trace length.
相关PDF资料 |
PDF描述 |
|---|---|
| PC34708VK | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA206 |
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| PCF1252-4T-T | 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO8 |
| PCF1252-4T | 1-CHANNEL POWER SUPPLY SUPPORT CKT, PDSO8 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PC34709VK | 制造商:Freescale Semiconductor 功能描述:PMIC 5SW,6 LDO,BST - Bulk |
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