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参数资料
| 型号： | PC34708VM |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 电源管理 |
| 英文描述： | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA206 |
| 封装： | 13 X 13 MM, 0.80 MM PITCH, LEAD FREE, MO-275HHAC-1, MAPBGA-206 |
| 文件页数： | 154/200页 |
| 文件大小： | 5160K |
| 代理商： | PC34708VM |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页当前第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
Analog Integrated Circuit Device Data
Freescale Semiconductor
57
PC34708
Functional Block Requirements and Behaviors
Buck Switchers Block Description and Application Information
7.2.9.2
Standby Delay
A provision to delay the Standby response is included. This allows the processor and peripherals, some time after a Standby
instruction has been received, to terminate processes to facilitate seamless Standby exiting and re-entrance into Normal
operating mode.
A programmable delay is provided to hold off the system response to a Standby event. When enabled (STBYDLY = 01, 10, or
11), STBYDLY will delay the STANDBY initiated response for the entire IC until the STBYDLY counter expires.
Note that this delay is applied only when going into Standby, and no delay is applied when coming out of Standby. Also, an
allowance should be accounted for synchronization of the asynchronous Standby event and the internal clocking edges (up to a
full 32 k cycle of additional delay).
7.3
Buck Switchers Block Description and Application Information
7.3.1
Buck Switchers General Control
Operational modes of the Buck switchers can be controlled by direct SPI programming, altered by the state of the STANDBY pin,
by direct state machine influence (i.e., entering Off or low power Off states, for example), or by load current magnitude when so
configured (Auto Pulse skip mode). Available modes include PWM with No Pulse Skipping (PWM), PWM with Pulse Skipping
(PWMPS), Pulse Frequency Mode (PFM), Automatic Pulse Skip (APS), and Off. The transition between the two modes PWMPS
and PWM can occur automatically, based on the load current (auto pulse skip mode). For light loading, the switchers should be
put into PFM mode to optimize efficiency.
SW1A/B, SW2, SW3, SW4A/B, and SW5, can be configured for mode switching with STANDBY or autonomously, based on load
current Auto pulse skip mode. Additionally, provisions are made for maintaining PFM operation in User off and Memhold modes,
to support state retention for faster startup from the Low Power Off modes for Warm Start or Warm Boot. SWxMODE[3:0] bits
will be reset to their default values defined by PUMSx settings by the startup sequencer.
Table 53 summarizes the Buck switcher programmability for Normal and Standby modes.
Table 52. Delay of STANDBY- Initiated Response
STBYDLY[1:0]
Function
00
No Delay
01
One 32 k period (default)
10
Two 32 k periods
11
Three 32 k periods
Table 53. Switcher Mode Control for Normal and Standby Operation
SWxMODE[3:0]
Normal Mode
Standby Mode
0000
Off
0001
PWM
Off
0010
PWMPS
Off
0011
PFM
Off
0100
APS
Off
0101
PWM
0110
PWM
APS
0111
Off
1000
APS
1001
PWM
PWMPS
1010
PWMPS
相关PDF资料 |
PDF描述 |
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参数描述 |
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