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参数资料
| 型号： | PC34708VM |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 电源管理 |
| 英文描述： | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA206 |
| 封装： | 13 X 13 MM, 0.80 MM PITCH, LEAD FREE, MO-275HHAC-1, MAPBGA-206 |
| 文件页数： | 149/200页 |
| 文件大小： | 5160K |
| 代理商： | PC34708VM |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页当前第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页
Analog Integrated Circuit Device Data
Freescale Semiconductor
52
PC34708
Functional Block Requirements and Behaviors
Power Control Logic Block Description and Application Information
7.2.7.1
Timing Diagrams
A Turn On event timing diagrams shown in Figure 9.
Figure 9. Power Up Timing Diagram
7.2.8
Power Up
At power up, switchers and regulators are sequentially enabled in time slots of 2.0 ms steps, to limit the inrush current after an
initial delay of 8.0 ms, in which the core circuitry gets enabled. To ensure a proper power up sequence, the outputs of the
switchers that are not enabled are discharged at the beginning of the Cold start with weak pull downs on the output. For that
same reason, a 8.0 ms delay allows the outputs of the linear regulators to be fully discharged as well, through the built in
discharge path. The peak inrush current per event is limited. Any under-voltage detection at BP is masked while the power up
sequencer is running. When the switcher is enabled it will start in PWM mode and for 3.0 ms and then it will switch over to the
mode that it is programmed to in the SPI.
The Power Up Mode Select pins PUMSx (x = 1,2,3,4,5) are used to configure the startup characteristics of the regulators. Supply
enabling and output level options are selected by hardwiring the PUMSx pins for the desired configuration. The recommended
power up strategy for end products is to bring up as little of the system as possible at booting, essentially sequestering just the
bare essentials to allow processor startup and software to run. With such a strategy, the startup transients are controlled at lower
levels, and the rest of the system power tree can be brought up by software. This allows optimization of supply ordering, where
specific sequences may be required, as well as supply default values. Software code can load up all of the required
programmable options, to avoid sneak paths, under/over-voltage issues, startup surges, etc, without any change in hardware.
The state of the PUMSx pins are latched in before any of the switchers or regulators are enabled, with the exception of VCORE.
PUMSx options and startup configurations will be robust to a PCUT event, whether occurring during normal operation or during
the 8.0 ms of pre-sequencer initialization, i.e., the system will not end up in an unexpected / undesirable consumption state.
Table 44 shows the initial setup for the voltage level of the switchers and regulators, and whether they get enabled.
RESETB
WDI
INT
UV Masking
8 ms
20 ms
12 ms
Power Up Sequencer
Turn On Verification
128 ms
2- Cold Start
1- Off
System Core Active
3- Watchdog
4- On
1- Off
3- Watchdog
Power up of the system upon a Turn On Event followed by a transition to the On state if WDI is pulled high
... or transition to Off state if WDI remains low
Turn On Event
Sequencer time slots
WDI Pulled Low
= Indeterminate State
ow
Turn on Event is based on PWRON being pulled low
8 ms
相关PDF资料 |
PDF描述 |
|---|---|
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