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参数资料
| 型号： | PEF22554E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, FRAMER, PBGA160 |
| 封装： | GREEN, PLASTIC, QFP-144 |
| 文件页数： | 212/700页 |
| 文件大小： | 25742K |
| 代理商： | PEF22554E |
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Data Sheet
29
Rev. 1.2, 2006-01-26
QuadFALC
TM
PEF 22554 E
Pin Descriptions
89
D1
IO
PU
Data Bus Line 1
SCI_RXD
I
PU
SCI Bus Serial Data In
only used if SCI interface mode is selected by IM(1:0) = 11
B.
SDI
I
PU
SPI Serial Data In
only used if SPI interface mode is selected by IM(1:0) = 10
B.
88
D0
IO
PU
Data Bus Line 0
SCI_TXD
I
PP or oD
SCI Bus Serial Data Out
only used if SCI interface mode is selected by IM(1:0) = 11
B.
SDO
I
PU
SPI Bus Serial Data Out
only used if SPI interface mode is selected by IM(1:0) = 10
B.
62
ALE
I
PU
Address Latch Enable
A high on this line indicates an address on an external
multiplexed address/data bus. The address information
provided on A(9:0) is internally latched with the falling edge
of ALE. This function allows the QuadFALC
TM to be
connected to a multiplexed address/data bus without the
need for external latches. In this case, pins A(7:0) must be
connected to the data bus pins externally. In case of
demultiplexed mode this pin can be connected directly to
VDD or can be left open.
85
RD
I
PU
Read Enable
Intel bus mode.
This signal indicates a read operation. When the
QuadFALC
TM is selected via CS, the RD signal enables the
bus drivers to output data from an internal register addressed
by A(10:0) to the Data Bus.
DS
IPU
Data Strobe
Motorola bus mode.
This pin serves as input to control read/write operations.
84
WR
I
PU
Write Enable
Intel bus mode.
This signal indicates a write operation. When CS is active the
QuadFALC
TM loads an internal register with data provided on
the data bus.
RW
IPU
Read/Write Select
Motorola bus mode.
This signal distinguishes between read and write operation.
40
DBW
I
PU
Data Bus Width select
Bus interface mode
A low signal on this input selects the 8-bit bus interface
mode. A high signal on this input selects the 16-bit bus
interface mode. In this case word transfer to/from the internal
registers is enabled. Byte transfers are implemented by using
A0 and BHE/BLE.
Table 1
I/O Signals for P-TQFP-144-8 (cont’d)
Pin No.
Name
Pin Type
Buffer
Type
Function
相关PDF资料 |
PDF描述 |
|---|---|
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
| PFC04108.2UHKT | 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PEF22554E-V2.1 | 制造商:Infineon Technologies AG 功能描述:DATACOM, FRAMER, PBGA160 |
| PEF22554EV2.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| PEF22554EV21 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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