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参数资料
| 型号： | PEF22554E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, FRAMER, PBGA160 |
| 封装： | GREEN, PLASTIC, QFP-144 |
| 文件页数： | 53/700页 |
| 文件大小： | 25742K |
| 代理商： | PEF22554E |
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QuadFALC
TM
PEF 22554 E
Functional Description E1
Data Sheet
146
Rev. 1.2, 2006-01-26
S
a6-Bit Detection According to ETS 300233
Four consecutive received S
a6-bits are checked for the combinations defined by ETS
300233. The QuadFALC
TM
detects the following fixed Sa6-bit combinations: SA61, SA62, SA63, SA64 = 1000
B, 1010B, 1100B, 1110B, 1111B.
All other possible 4-bit combinations are grouped to status “X”.
A valid S
a6-bit combination must occur three times in a row. The corresponding status bit in register RSA6S is set.
Register RSA6S is of type “clear on read”. Any status change of the S
a6-bit combinations causes an interrupt
(ISR0.SA6SC).
During the basic frame asynchronous state update of register RSA6S and interrupt status ISR0.SA6SC is
disabled. In multiframe format the detection of the S
a6-bit combinations can be done either synchronously or
asynchronously to the submultiframe (FMR3.SA6SY). In synchronous detection mode updating of register RSA6S
is done in the multiframe synchronous state (FRS0.LMFA = 0). In asynchronous detection mode updating is
independent of the multiframe synchronous state.
S
a6-Bit Error Indication Counters
The S
a6-bit error indication counter CRC2L/H (16 bits) counts the received Sa6-bit sequence 0001B or 0011B in
every CRC submultiframe. In the primary rate access digital section this counter option gives information about
CRC errors reported from the TE by the S
a6 bit. Incrementing is only possible in the multiframe synchronous state.
The S
a6-bit error indication counter CRC3L/H (16 bits) counts the received Sa6-bit sequence 0010B or 0011B in
every CRC submultiframe. In the primary rate access digital section this counter option gives information about
CRC errors detected at T-reference point and reporting them by the S
a6-bit. Incrementing is only possible in the
multiframe synchronous state.
4.4.3.8
E-Bit Access (E1)
Due to signaling requirements, the E-bits of frame 13 and frame 15 of the CRC multiframe can be used to indicate
received errored submultiframes:
相关PDF资料 |
PDF描述 |
|---|---|
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
| PFC04108.2UHKT | 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PEF22554E-V2.1 | 制造商:Infineon Technologies AG 功能描述:DATACOM, FRAMER, PBGA160 |
| PEF22554EV2.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| PEF22554EV21 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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