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参数资料
| 型号： | PEF22554E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, FRAMER, PBGA160 |
| 封装： | GREEN, PLASTIC, QFP-144 |
| 文件页数： | 570/700页 |
| 文件大小： | 25742K |
| 代理商： | PEF22554E |
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Data Sheet
611
Rev. 1.2, 2006-01-26
QuadFALCTM
PEF 22554 E
T1/J1 Registers
Interrupt Status Register 0
All bits are reset when ISR0 is read. If bit GCR.VIS is set, interrupt statuses in ISR0 are flagged although they are
masked by register IMR0. However, these masked interrupt statuses neither generate a signal on INT (or INT1,
INT2), nor are visible in register GIS. See Chapter 3.4.4.
ISR0_T
Offset
Reset Value
Interrupt Status Register 0
xx68H
00H
Field
Bits
Type
Description
RME
7
r
Receive Message End - HDLC Channel 1
One complete message of length less than 32 bytes, or the last part of a
frame at least 32 bytes long is stored in the receive FIFO, including the
status byte.The complete message length can be determined reading the
RBCH, RBCL registers, the number of bytes currently stored in RFIFO is
given by RBC(4:0). Additional information is available in the RSIS
register.
RFS_BIV
6
r
Receive Frame Start - HDLC Channel 1
This is an early receiver interrupt activated after the start of a valid frame
has been detected, i.e. after an address match (in operation modes
providing address recognition), or after the opening flag (transparent
mode 0) is detected, delayed by two bytes. After a RFS interrupt, the
contents of RAL1and RSIS.3-1 are valid and can be read by the external
micro controller.
BOM Frame Invalid - HDLC Channel 1
Only valid if CCR2.RBFE is set.When the BOM receiver left the valid
BOM status (detecting 7 out of 10 equal BOM frames) this interrupt is
generated.
ISF
5
r
Incorrect Sync Format - HDLC Channel 1
The QuadFALCTM did not detect eight consecutive ones within 32 bits in
BOM mode. Only valid if BOM receiver has been activated.
RMB
4
r
Receive Multiframe Begin
This bit is set with the beginning of a received multiframe of the receive
line timing.
RSC
3
r
Received Signaling Information Changed
This interrupt bit is set during each multiframe in which signaling
information on at least one channel changes its value from the previous
multiframe. This interrupt only occurs in the synchronous state. The
registers RS(12:1) should be read within the next 3 ms otherwise the
contents is lost.
CRC6
2
r
Receive CRC6 Error
0B
No CRC6 error occurs.
1B
The CRC6 check of the last received multiframe failed.
相关PDF资料 |
PDF描述 |
|---|---|
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
| PFC04108.2UHKT | 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PEF22554E-V2.1 | 制造商:Infineon Technologies AG 功能描述:DATACOM, FRAMER, PBGA160 |
| PEF22554EV2.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| PEF22554EV21 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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