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参数资料
| 型号： | PEF22554E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, FRAMER, PBGA160 |
| 封装： | GREEN, PLASTIC, QFP-144 |
| 文件页数： | 320/700页 |
| 文件大小： | 25742K |
| 代理商： | PEF22554E |
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Data Sheet
387
Rev. 1.2, 2006-01-26
QuadFALCTM
PEF 22554 E
E1 Registers
CRC Error Counter 3 Lower Byte
CRC Error Counter (detected at T Reference Point in Sa6-Bit) for CE(15:0): GCR.ECMC = 0B: If doubleframe
format is selected, CEC3H/L has no function. If CRC-multiframe mode is enabled, CEC3H/L works as Sa6-bit error
indication counter (16 bits) which counts the Sa6-bit sequence 0010B and 0011B in every received CRC
submultiframe. Incrementing the counter is only possible in the multiframe synchronous state FRS0.LMFA =
0B.Sa6-bit sequence: SA61, SA62, SA63, SA64 = 0010B or 0011B where SA61 is received in frame 1 or 9 in every
multiframe. The error counter does not roll over. During alarm simulation, the counter is incremented once per
submultiframe up to its saturation.
CEC3L_E
Offset
Reset Value
CRC Error Counter 3 Lower Byte
xx5AH
00H
Field
Bits
Type
Description
CE7
7
r
Multiframe Counter
GCR.ECMC = 1B: This 6-bit counter increments with each multiframe
period in the asynchronous state FRS0.LFA/LMFA = 1B. During alarm
simulation, the counter is incremented once per multiframe up to its
saturation.
CE6
6
CE5
5
CE4
4
CE3
3
CE2
2
CE1
1
r
Change of Frame Alignment Counter
GCR.ECMC = 1B: This 2-bit counter increments with each detected
change of frame/multiframe alignment. The error counter does not roll
over. During alarm simulation, the counter is incremented once per
multiframe up to its saturation. Clearing and updating the counter is done
according to bit FMR1.ECM.
If this bit is reset the error counter is permanently updated in the buffer.
For correct read access of the error counter bit DEC.DCEC3 has to be
set. With the rising edge of this bit updating of the buffer is stopped and
the error counter is reset. Bit DEC.DCEC3 is reset automatically with
reading the error counter high byte. If FMR1.ECM is set every second
(interrupt ISR3.SEC) the error counter is latched and then automatically
reset. The latched error counter state should be read within the next
second.
CE0
0
相关PDF资料 |
PDF描述 |
|---|---|
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
| PFC04108.2UHKT | 1 ELEMENT, 8.2 uH, GENERAL PURPOSE INDUCTOR |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PEF22554E-V2.1 | 制造商:Infineon Technologies AG 功能描述:DATACOM, FRAMER, PBGA160 |
| PEF22554EV2.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
| PEF22554EV21 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PEF22554EV3.1-G | 功能描述:网络控制器与处理器 IC T/E RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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