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参数资料
| 型号： | QL5842-33BPSN484M |
| 厂商： | QUICKLOGIC CORP |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA484 |
| 封装： | 23 X 23 MM, 2.13 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, MS-034AAJ-1, BGA-484 |
| 文件页数： | 46/76页 |
| 文件大小： | 1409K |
| 代理商： | QL5842-33BPSN484M |
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2006 QuickLogic Corporation
QL58x2 Enhanced QuickPCI Family Data Sheet Rev. K
50
VDED2
I
Voltage tolerance for JTAG pins
(TDI, TMS, TCK, and TRSTB)
These pins specify the input voltage tolerance for the
JTAG input pins. The legal range for VDED2 is between
1.71 V and 3.6 V. These do not specify output voltage
of the JTAG output, TDO. Refer to the VDED pin section
for specifying the JTAG output voltage.
VCCPLL
I
Power Supply pin for PLL
Connect to 2.5 V or 3.3 V supply. For backwards
compatibility with QL5632/QL5732 devices, connect to
2.5 V. To minimize static power consumption when
designs do not utilize the PLLs, you may connect
VCCPLL to GND. If VCCPLL is grounded, the PLL is
disabled.
PLL_RESET
I
PLL reset pin
If PLL_RESET is asserted, then CLKNET_OUT and
PLLPAD_OUT are reset to 0. This signal must be
asserted and then released in order for the
LOCK_DETECT to work.
If a PLL module is not used, then the associated
PLLRST<x> must be connected to VDED.
Table 33: PLLOUT Pin Supply Voltage
PLLOUT
VCCIO
PLLOUT(0)
VCCIO(E)
PLLOUT(1)
VCCIO(B)
PLLOUT(2)
VCCIO(A)
PLLOUT(3)
VCCIO(F)
Table 32: Pin Descriptions (Continued)
Pin
Direction
Function
Description
相关PDF资料 |
PDF描述 |
|---|---|
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| QR80C51XXX:R | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44 |
| QD80C31-S:D | 8-BIT, 20 MHz, MICROCONTROLLER, CDIP40 |
| QP80C51FXXX-L:D | 8-BIT, MROM, 6 MHz, MICROCONTROLLER, PDIP40 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| QL63F5SA | 制造商:未知厂家 制造商全称:未知厂家 功能描述:InGaAlP Laser Diode |
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