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参数资料
| 型号： | QL8150-6PT280I |
| 厂商： | QUICKLOGIC CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 640 CLBS, 188946 GATES, PBGA280 |
| 封装： | 0.80 MM PITCH, LFBGA-280 |
| 文件页数： | 9/96页 |
| 文件大小： | 1607K |
| 代理商： | QL8150-6PT280I |
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2007 QuickLogic Corporation
Eclipse II Family Data Sheet Rev. Q
17
Figure 14: Power-On Reset
Low Power Mode
Quiescent power consumption of all Eclipse II devices can be reduced significantly by de-activating the charge
pumps inside the architecture. By applying 3.3 V to the VPUMP pin, the internal charge pump is de-
activated—this effectively reduces the static and dynamic power consumption of the device. The Eclipse II
device is fully functional and operational in the Low Power mode. Users who have a 3.3 V supply available in
their system should take advantage of this low power feature by tying the VPUMP pin to 3.3 V. Otherwise, if
a 3.3 V supply is not available, this pin should be tied to ground.
VCC
Power-on
Reset
Q
XXXXXXX
0
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PDF描述 |
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参数描述 |
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