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参数资料
| 型号： | RTPXA270C0C312 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 312 MHz, RISC PROCESSOR, PBGA356 |
| 封装： | 13 X 13 MM, 1 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, VFBGA-356 |
| 文件页数： | 10/128页 |
| 文件大小： | 1560K |
| 代理商： | RTPXA270C0C312 |
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Electrical, Mechanical, and Thermal Specification
6-43
Intel PXA270 Processor
AC Timing Specifications
6.5
LCD Timing Specifications
Figure 6-28 describes the LCD timing parameters. The LCD pin timing specifications are
referenced to the pixel clock (L_PCLK_WR). Table 6-22 gives the values for the parameters.
Figure 6-28. LCD Timing Definitions
Table 6-22. LCD Timing Specifications
Symbol
Description
Min
Max
Units
Notes
Tpclkdv
L_PCLK_WR rise/fall to L_LDD<17:0>
driven valid
—
14
ns
1
Tpclklv
L_PCLK_WR fall to L_LCLK_A0 driven
valid
—
14
ns
2
Tpclkfv
L_PCLK_WR fall to L_FCLK_RD driven
valid
—
14
ns
2
Tpclkbv
L_PCLK_WR rise to L_BIAS driven valid
—
14
ns
2
NOTES:
1. The LCD data pins can be programmed to be driven on either the rising or falling edge of the pixel clock
(L_PCLK_WR).
2. These LCD signals can toggle when L_PCLK_WR is not clocking (between frames). At this time, they are
clocked with the internal version of the pixel clock before it is driven out onto the L_PCLK_WR pin.
L_LDD[17:0]
(rise)
L_LDD[17:0]
(fall)
L_PCLK_WR
L_LCLK_A0
L_BIAS
L_FCLK_RD
Tpclkdv
Tpclklv
Tpclkfv
Tpclkbv
Tpclkdv
相关PDF资料 |
PDF描述 |
|---|---|
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| RV5C387A-F | 0 TIMER(S), REAL TIME CLOCK, PDSO10 |
| RX-4571LC | REAL TIME CLOCK, PDSO12 |
| RX-4571SA | REAL TIME CLOCK, PDSO14 |
| RX-4571SA | 0 TIMER(S), REAL TIME CLOCK, PDSO14 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| RTPXA270C0C416 | 制造商:Intel 功能描述:MPU PXA270 416MHz 3V/3.3V 356-Pin VFBGA |
| RTPXA270C0C624 | 制造商:Intel 功能描述:MPU PXA270 624MHz 3V/3.3V 356-Pin VFBGA |
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