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参数资料
| 型号： | RTPXA270C0C312 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 312 MHz, RISC PROCESSOR, PBGA356 |
| 封装： | 13 X 13 MM, 1 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, VFBGA-356 |
| 文件页数： | 99/128页 |
| 文件大小： | 1560K |
| 代理商： | RTPXA270C0C312 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页当前第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
6-8
Electrical, Mechanical, and Thermal Specification
Intel PXA270 Processor
AC Timing Specifications
Figure 6-6. Deep-Sleep-Mode Timing
VCC_USB, VCC_IO,
VCC_BB, VCC_MEM,
VCC_LCD, VCC_USIM
VCC_CORE, VCC_SRAM,
VCC_PLL
NORMAL
SYS_EN
PWR_EN
nVDD_FAULT
nRESET_OUT
Wakeup Event
DEEP SLEEP (ENTRY)
DEEP SLEEP
DEEP SLEEP (EXIT)
Intel PXA27x State:
Tdentry
Tdexit
Tdpwr_delay
Deep-Sleep Command
Tdsys_delay
Tenable
Table 6-7. Deep-Sleep Mode Timing Specifications
Symbol
Description
Min
Typical
Max3
Units
tdentry5
Delay between deep-sleep command
issue to de-assertion of SYS_EN
0.66
—
1.661
msec
tenable
Delay between de-assertion of PWR_EN
and SYS_EN
—
30
—
usec
tdexit
Delay between wakeup event and run
mode
0.60
—
261.752,4
msec
tdsysdelay
Delay between assertion of SYS_EN to
PWR_EN2
0
—
125
msec
tdpwrdelay
Delay between assertion of PWR_EN to
PLL enable2
0
—
125
msec
NOTE: Timing specifications for nBATT_FAULT and/or nVDD_FAULT asserted deep-sleep mode entry are
below:
Fault assert
Delay between nBATT_FAULT or
nVDD_FAULT assertion (during all
modes of operation including sleep
mode) and deep-sleep mode entry6(The
de-assertion of SYS_EN defines when
the processor is in deep-sleep mode)
0.33
—
1.56
msec
NOTES:
1. -1ms if not using DC2DC
2. 0.15ms less time if exiting from Deep-sleep mode to 13M mode
3. Add 0.1ms if the wake up event is external
4. Oscillator start/crystal stable times are programmable (300uS-11mS)
NOTE: 6ms is user programmable using the OSCC[OSD] bit. The remaining 5ms is an internal timer which
counts until the oscillator is stable. (Typical stabilization is 500
s. Maximum can be upto 5ms)
5. nRESET_OUT and nVDD_FAULT are programmable during sleep mode
6. Assumes PMCR[BIDAE or VIDAE] bits are set to zero (default state) - The PMCR[BIDAE or VIDAE] bits
are only read by the processor if nBATT_FAULT or nVDD_FAULT signals are asserted
相关PDF资料 |
PDF描述 |
|---|---|
| RCPXA270C0C520 | 520 MHz, MICROPROCESSOR, PBGA356 |
| RV5C387A-F | 0 TIMER(S), REAL TIME CLOCK, PDSO10 |
| RX-4571LC | REAL TIME CLOCK, PDSO12 |
| RX-4571SA | REAL TIME CLOCK, PDSO14 |
| RX-4571SA | 0 TIMER(S), REAL TIME CLOCK, PDSO14 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| RTPXA270C0C416 | 制造商:Intel 功能描述:MPU PXA270 416MHz 3V/3.3V 356-Pin VFBGA |
| RTPXA270C0C624 | 制造商:Intel 功能描述:MPU PXA270 624MHz 3V/3.3V 356-Pin VFBGA |
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| RTPXA270C5C312 868403 | 制造商:Marvell 功能描述: |
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