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参数资料
| 型号： | RTPXA270C0C312 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 312 MHz, RISC PROCESSOR, PBGA356 |
| 封装： | 13 X 13 MM, 1 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, VFBGA-356 |
| 文件页数： | 116/128页 |
| 文件大小： | 1560K |
| 代理商： | RTPXA270C0C312 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页当前第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
6-24
Electrical, Mechanical, and Thermal Specification
Intel PXA270 Processor
AC Timing Specifications
6.4.4.1.2
Synchronous Flash Read Parameters and Timing Diagrams
Table 6-17 lists the timing parameters used in Figure 6-15, and, for stacked flash packages,
Table 6-17. Synchronous Flash Read AC Specifications (Sheet 1 of 2)
Symbols
Parameters
MIN
TYP
MAX MIN
TYP
MAX
MIN
TYP
MAX
Units
No
tes
Divide by 12
Divide by 23
Divide by 44
tffCLK
SDCLK0 period
9.6
—
38.5
19.
2
—
76.9
38.5
—
154
ns
1
tffAS
MA<25:0> setup to
nSDCAS (as
nADV) asserted
1
—
1
—
2
1
—
4
CLK_MEM
—
tffCES
nCS setup to
nSDCAS (as
nADV) asserted
1
—
1
—
2
1
—
4
CLK_MEM
—
tffADV
nSDCAS (as
nADV) pulse width
1
—
1
3
—
3
7
—
7
CLK_MEM
—
tffOS
nSDCAS (as
nADV) deassertion
to nOE assertion
1
FCC – 1
(for
FCC<5)
FCC – 2
(for
FCC>=5)
13
2
(FCC – 1)
* 2
(for
FCC<5)
(FCC – 2)
* 2
(for
FCC>=5)
26
7
(FCC * 4)
– 7
(for
FCC<5)
(FCC – 2)
* 4
(for
FCC>=5)
52
CLK_MEM
5
tffCEH
nOE deassertion to
nCS deassertion
4
—
4
8
—
8
16
—
16
CLK_MEM
—
tffDS
CLK to data valid
2
FCC
15
2
FCC
15
2
FCC
15
CLK_MEM
5
VCC_MEM =
1.8V +20% / -5%6
VCC_MEM =
2.5V +/- 10%7
VCC_MEM =
3.3V +/- 10%8
tffSDOS
MA<25:0>,
MD<31:0>,
DQM<3:0>,
nCS<3:0>,
nSDCAS (nADV),
nWE, nOE,
RDnWR output
setup time to
SDCLK<2:1> rise
TBD
—
TB
D
—
TBD
—
ns
—
tffSDOH
MA<25:0>,
MD<31:0>,
DQM<3:0>,
nCS<3:0>,
nSDCAS (nADV),
nWE, nOE,
RDnWR output
hold time from
SDCLK<2:1> rise
TBD
—
TB
D
—
TBD
—
ns
—
VCC_CORE = 0.85 V +/
– 10%, with 1.71 V<=
VCC_MEM <= 3.63 V
VCC_CORE = 1.1 V +/–
10%, with 1.71 V <=
VCC_MEM <= 3.63 V
VCC_CORE = 1.3 V +/–
10%, with 1.71 V <=
VCC_MEM <= 3.63 V
相关PDF资料 |
PDF描述 |
|---|---|
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| RX-4571SA | 0 TIMER(S), REAL TIME CLOCK, PDSO14 |
相关代理商/技术参数 |
参数描述 |
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