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参数资料
型号： TMS320F241PGS
厂商： TEXAS INSTRUMENTS INC
元件分类： 数字信号处理
英文描述： 0-BIT, 5 MHz, OTHER DSP, PQFP64
封装： PLASTIC, QFP-64
文件页数： 88/122页
文件大小： 1465K
代理商： TMS320F241PGS
TMS320F243, TMS320F241
DSP CONTROLLERS
SPRS064D DECEMBER 1997 REVISED FEBRUARY 2006
68
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
instruction set summary (continued)
Table 20. TMS320x24x Instruction Set Summary (Continued)
x24x
DESCRIPTION
WORDS/
OPCODE
x24x
MNEMONIC
DESCRIPTION
WORDS/
CYCLES
MSB
LSB
Branch if accumulator
≠ 0
2/4/2
1110
0011
0000
1000
Branch if accumulator
≠ 0
2/4/2
Branch Address
BCND
Branch on overflow
2/4/2
1110
0011
0010
BCND
Branch on overflow
2/4/2
Branch Address
Branch if accumulator = 0
2/4/2
1110
0011
1000
Branch if accumulator = 0
2/4/2
Branch Address
BIT
Test bit
1/1
0100
BITx
IADD
RESS
BITT
Test bit specified by TREG
1/1
0110
1111
IADD
RESS
Block move from data memory to data memory source immediate
2/3
1010
1000
IADD
RESS
BLDD
Block move from data memory to data memory source immediate
2/3
Branch Address
BLDD
Block move from data memory to data memory destination immediate
2/3
1010
1001
IADD
RESS
Block move from data memory to data memory destination immediate
2/3
Branch Address
BLPD
Block move from program memory to data memory
2/3
1010
0101
IADD
RESS
BLPD
Block move from program memory to data memory
2/3
Branch Address
CALA
Call subroutine indirect
1/4
1011
1110
0011
0000
CALL
Call subroutine
2/4
0111
1010
IADD
RESS
CALL
Call subroutine
2/4
Routine Address
CC
Conditional call subroutine
2/4/2
1110
10TP
ZLVC
CC
Conditional call subroutine
2/4/2
Routine Address
Configure block as data memory
1/1
1011
1110
0100
Enable interrupt
1/1
1011
1110
0100
0000
Reset carry bit
1/1
1011
1110
0100
1110
CLRC
Reset overflow mode
1/1
1011
1110
0100
0010
CLRC
Reset sign-extension mode
1/1
1011
1110
0100
0110
Reset test / control flag
1/1
1011
1110
0100
1010
Reset external flag
1/1
1011
1110
0100
1100
CMPL
Complement accumulator
1/1
1011
1110
0000
0001
CMPR
Compare auxiliary register with auxiliary register AR0
1/1
1011
1111
0100
01CM
DMOV
Data move in data memory
1/1
0111
IADD
RESS
IDLE
Idle until interrupt
1/1
1011
1110
0010
IN
Input data from port
2/2
1010
1111
IADD
RESS
IN
Input data from port
2/2
16BIT
I/O
PORT
ADRS
INTR
Software-interrupt
1/4
1011
1110
011K
KKKK
Load accumulator with shift
1/1
0001
SHFT
IADD
RESS
LACC
Load accumulator long immediate with shift
2/2
1011
1111
1000
SHFT
LACC
Load accumulator long immediate with shift
2/2
16-Bit Constant
Zero low accumulator and load high accumulator
1/1
0110
1010
IADD
RESS
In x24x devices, the BLDD instruction does not work with memory-mapped registers IMR, IFR, and GREG.
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