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参数资料
| 型号： | V58C2256324SAH-40 |
| 厂商： | PROMOS TECHNOLOGIES INC |
| 元件分类： | DRAM |
| 英文描述： | 8M X 32 DDR DRAM, 0.6 ns, PBGA144 |
| 封装： | LEAD FREE, BGA-144 |
| 文件页数： | 27/37页 |
| 文件大小： | 557K |
| 代理商： | V58C2256324SAH-40 |
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33
V58C2256324SA Rev. 1.0 November 2003
ProMOS TECHNOLOGIES
V58C2256324SA
SSTL_2 Output Buffers
The input voltage provided to the receiver depends on three parameters:
■ VDDQ and current drive capabilities of the output buffer
■ Termination voltage
■ Termination resistance
■ V
DDQ <= VDD
Class II SSTL_2 Output Buffer (Driver)
Capacitance (VDD = 2.5V, TA = 25°C, f = 1MHz)
AC Characteristics
Parameter
Symbol
Min
Max
Unit
Input capacitance (A0~A11, BA0~BA1)
CIN1
2.5
4.5
pF
Input capacitance
( CK, CK, CKE, CS, RAS, CAS, WE )
CIN2
2.5
5.0
pF
Data & DQS input/output capacitance (DQ0~DQ31)
COUT
2.5
5.5
pF
Input capacitance (DM0 ~ DM3)
CIN3
2.5
5.5
pF
Parameter
Symbol
-28
-33
-36
-40
Unit
Min
Max
Min
Max
Min
Max
Min
Max
CK cycle time
CL=3
4.0
4.5
5.0
ns
CL=4
3.3
3.6
4.0
ns
CL=5
2.85
3.3
3.6
4.0
CK high level width
tCH
0.45
0.55
0.45
0.55
0.45
0.55
0.45
0.55
tCK
CK low level width
tCL
0.45
0.55
0.45
0.55
0.45
0.55
0.45
0.55
tCK
DQS out access time from CK
tDQSCK
-0.50
+0.50
-0.50
+0.50
-0.55
+0.55
-0.60
+0.60
ns
Output access time from CK
tAC
-0.50
+0.50
-0.50
+0.50
-0.55
+0.55
-0.60
+0.60
ns
Data strobe edge to output data edge
tDQSQ
-
0. 35
-
0. 4
-
0.4
-
0.4
ns
Data strobe edge to output data edge
tQHS
-
0. 30
-
0. 33
-
0.37
-
0.4
ns
Read preamble
tRPRE
0.9
1.1
0.9
1.1
0.9
1.1
0.9
1.1
tCK
Read postamble
tRPST
0.4
0.6
0.4
0.6
0.4
0.6
0.4
0.6
tCK
CK to valid DQS-in
tDQSS
0.70
1.15
0.75
1.15
0.75
1.2
0.8
1.2
tCK
DQS-In setup time
tWPRES
0
-
0
-
0
-
0
-
ns
VREF
VIN
VTT = 0.5 *VDDQ
CLOAD = 15pF
VDDQ
VSSQ
VOUT
Receiver
RT=50
Output
Buffer
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