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参数资料
| 型号： | XC4VLX15-11FFG676I |
| 厂商： | XILINX INC |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1536 CLBS, 1205 MHz, PBGA676 |
| 封装： | LEAD FREE, FBGA-676 |
| 文件页数： | 20/58页 |
| 文件大小： | 1863K |
| 代理商： | XC4VLX15-11FFG676I |
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Virtex-4 FPGA Data Sheet: DC and Switching Characteristics
DS302 (v3.7) September 9, 2009
Product Specification
27
Table 33: OLOGIC Switching Characteristics
Symbol
Description
Speed Grade
Units
-12
-11
-10
Setup/Hold
TODCK / TOCKD
D1/D2 pins Setup/Hold with respect to CLK
0.52
–0.22
0.62
–0.22
0.75
–0.22
ns
TOOCECK / TOCKOCE
OCE pin Setup/Hold with respect to CLK
0.53
–0.33
0.64
–0.33
0.77
–0.33
ns
TOSRCK / TOCKSR
SR/REV pin Setup/Hold with respect to CLK
0.99
–0.55
1.18
–0.55
1.42
–0.55
ns
TOTCK / TOCKT
T1/T2 pins Setup/Hold with respect to CLK
0.52
–0.22
0.62
–0.22
0.75
–0.22
ns
TOTCECK / TOCKTCE
TCE pin Setup/Hold with respect to CLK
0.53
–0.33
0.64
–0.33
0.77
–0.33
ns
Combinatorial
TODQ
D1 to OQ out
0.56
0.65
0.76
ns
TOTQ
T1 to TQ out
0.56
0.65
0.76
ns
Sequential Delays
TIOSRON
REV pin to TQ out
1.14
1.37
1.64
ns
TOCKQ
CLK to OQ/TQ out
0.41
0.49
0.59
ns
TRQ
SR/REV pin to OQ/TQ out
1.14
1.37
1.64
ns
TGSRQ
Global Set/Reset to Q outputs
1.54
1.73
2.03
ns
Set/Reset
TRPW
Minimum Pulse Width, SR/REV inputs
0.53
0.59
0.70
ns,
Min
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PDF描述 |
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