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参数资料
| 型号： | AD9511BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 47/60页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK DIST 5OUT PLL 48LFCSP |
| 标准包装： | 750 |
| 类型： | 扇出缓冲器（分配），除法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:5 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.2GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 48-LFCSP-VQ（7x7） |
| 包装： | 带卷 (TR) |
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AD9511
Rev. A | Page 51 of 60
Reg.
Addr.
(Hex)
Bit(s) Name
Description
Output Level
LVPECL
OUT0
(OUT1)
(OUT2)
Output Single-Ended Voltage Levels for LVPECL Outputs.
3D (3E) (3F) <3:2>
<3>
<2>
Output Voltage (mV)
0
490
0
1
330
1
0
805 (Default)
1
650
3D (3E) (3F) <7:4>
Not Used
40 (41)
<0>
Power-Down
LVDS/CMOS
OUT3
(OUT4)
Power-Down Bit for Both Output and LVDS Driver.
0 = LVDS/CMOS on (Default).
1 = LVDS/CMOS Power-Down.
Output Current
Level
LVDS
OUT3
(OUT4)
40 (41)
<2:1>
<2>
<1>
Current (mA)
Termination (Ω)
0
1.75
100
0
1
3.5 (Default)
100
1
0
5.25
50
1
7
50
40 (41)
<3>
LVDS/CMOS
Select
OUT3
(OUT4)
0 = LVDS (Default).
1 = CMOS.
40 (41)
<4>
Inverted CMOS
Driver
OUT3
(OUT4)
Affects Output Only when in CMOS Mode.
0 = Disable Inverted CMOS Driver (Default).
1 = Enable Inverted CMOS Driver.
40 (41)
<7:5>
Not Used.
42 (43) (44) <7:0>
Not Used.
45
<0>
Clock Select
0: CLK2 Drives Distribution Section.
1: CLK1 Drives Distribution Section (Default).
45
<1>
CLK1 Power-Down 1 = CLK1 Input Is Powered Down (Default = 0b).
45
<2>
CLK2 Power-Down 1 = CLK2 Input Is Powered Down (Default = 0b).
45
<3>
Prescaler Clock
Power-Down
1 = Shut Down Clock Signal to PLL Prescaler (Default = 0b).
45
<4>
REFIN Power-
Down
1 = Power-Down REFIN (Default = 0b).
45
<5>
All Clock Inputs
Power-Down
1 = Power-Down CLK1 and CLK2 Inputs and Associated Bias and Internal Clock Tree;
(Default = 0b).
45
<7:6>
Not Used.
46 (47)
(48) (49)
<7:0>
Not Used.
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PDF描述 |
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