参数资料
型号: ADSP-21365YSWZ-2BA
厂商: ANALOG DEVICES INC
元件分类: 数字信号处理
英文描述: 16-BIT, 55.55 MHz, OTHER DSP, PQFP144
封装: MS-026BFB-HD, LQFP-144
文件页数: 28/56页
文件大小: 2748K
代理商: ADSP-21365YSWZ-2BA
ADSP-21362/ADSP-21363/ADSP-21364/ADSP-21365/ADSP-21366
Input Data Port (IDP)
The timing requirements for the IDP are given in Table 30. IDP
signals (SCLK, FS, SDATA) are routed to the DAI_P20–1 pins
using the SRU. Therefore, the timing specifications provided
below are valid at the DAI_P20–1 pins.
Table 30. IDP
Parameter
Min
Max
Unit
Timing Requirements
tSISFS
1
FS Setup Before SCLK Rising Edge
3
ns
tSIHFS
1
FS Hold After SCLK Rising Edge
3
ns
tSISD
1
SData Setup Before SCLK Rising Edge
3
ns
tSIHD
1
SData Hold After SCLK Rising Edge
3
ns
tIDPCLKW
Clock Width
9
ns
tIDPCLK
Clock Period
24
ns
1 DATA, SCLK, FS can come from any of the DAI pins. SCLK and FS can also come via PCG or SPORTs. PCG’s input can be either CLKIN or any of the DAI pins.
SAMPLE EDGE
DAI_P20-1
(SCLK)
DAI_P20-1
(FS)
tSISFS
tSIHFS
tIDPCLK
DAI_P20-1
(SDATA)
tIDPCLKW
tSISD
tSIHD
Figure 24. IDP Master Timing
Rev. B
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June 2007
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PDF描述
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相关代理商/技术参数
参数描述
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