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参数资料
| 型号： | EVAL-ADE5169EBZ-2 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 45/156页 |
| 文件大小： | 0K |
| 描述： | BOARD EVALUATION FOR AD5169 |
| 标准包装： | 1 |
| 主要目的： | 电源管理，电度表/功率表 |
| 嵌入式： | 是 |
| 已用 IC / 零件： | ADE5169 |
| 主要属性： | 用于汇编语言和 C 代码的 IAR 工具 |
| 次要属性： | 隔离和非隔离输出选项 |
| 已供物品： | 板，软件 |
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Data Sheet
Table 37. Accumulation Mode Register (ACCMODE, Address 0x0F)
ADE5166/ADE5169/ADE5566/ADE5569
Bit
7
Mnemonic
ICHANNEL 1
Default
0
Description
This bit indicates the current channel used to measure energy in antitampering mode.
0 = Channel A (I PA ).
1 = Channel B (I PB ).
6
FAULTSIGN 1
0
Configuration bit to select the event that triggers a fault interrupt.
0 = FAULTSIGN interrupt occurs when the part enters fault mode.
1 = FAULTSIGN interrupt occurs when the part enters normal mode.
5
VARSIGN 2
0
Configuration bit to select the event that triggers a reactive power sign interrupt.
If cleared to 0, a VARSIGN interrupt occurs when reactive power changes from positive to negative.
If set to 1, a VARSIGN interrupt occurs when reactive power changes from negative to positive.
4
APSIGN
0
Configuration bit to select the event that triggers an active power sign interrupt.
If cleared to 0, an APSIGN interrupt occurs when active power changes from positive to negative.
If set to 1, an APSIGN interrupt occurs when active power changes from negative to positive.
3
2
ABSVARM 2
SAVARM 2
0
0
Logic 1 enables absolute value accumulation of reactive power in energy register and pulse output.
Logic 1 enables reactive power accumulation depending on the sign of the active power.
If active power is positive, var is accumulated as it is.
If active power is negative, the sign of the var is reversed for the accumulation.
This accumulation mode affects both the var registers (VARHR, RVARHR, LVARHR) and the pulse
output when connected to the reactive measurement. 2
1
0
POAM
ABSAM
0
0
Logic 1 enables positive-only accumulation of active power in energy register and pulse output.
Logic 1 enables absolute value accumulation of active power in energy register and pulse output.
1
2
This function is not available in the ADE5566 and ADE5569.
This function is not available in the ADE5166 and ADE5566.
Table 38. Gain Register (GAIN, Address 0x1B)
Bit
[7:5]
4
3
[2:0]
Mnemonic
PGA2
Reserved
CFSIGN_OPT
PGA1
Default
000
0
0
000
Description
These bits define the voltage channel input gain.
PGA2
Result
000
Gain = 1
001
Gain = 2
010
Gain = 4
011
Gain = 8
100
Gain = 16
Reserved.
This bit defines where the CF change of sign detection (APSIGN or VARSIGN) is implemented.
CFSIGN_OPT
Result
0
Filtered power signal
1
On a per CF pulse basis
These bits define the curre nt channel input gain.
PGA1
Result
000
Gain = 1
001
Gain = 2
010
Gain = 4
011
Gain = 8
100
Gain = 16
Table 39. Mode 3 Register (MODE3, Address 0x2B)
Bit
[7:2]
1
0
Mnemonic
Reserved
ZX1
ZX2
Default
0
0
0
Description
Reserved.
Setting this bit enables the zero-crossing output signal on P1.2.
Setting this bit enables the zero-crossing output signal on P0.5.
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