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参数资料
| 型号： | GT-48002A |
| 厂商： | Galileo Technology Services, LLC |
| 英文描述： | Switched Fast Ethernet Controller for 100BaseX(100BaseX交换式快速以太网控制器) |
| 中文描述： | 交换式快速以太网控制器（100BaseX交换式快速以太网控制器的100BaseX） |
| 文件页数： | 94/102页 |
| 文件大小： | 1001K |
| 代理商： | GT-48002A |
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Switched Fast Ethernet Controller
Revision 1.2
91
Internal Register/DRAM Base Address Register, Offset: 0x010
Note: This register has special behavior in a plug and play environment (see Section 11.4 on page 47). The device
number can be changed in this register after RESET (see Section 7.3 on page 28).
Interrupt Pin and Line , Offset: 0x03c
Bi ts
Fi eld Nam e
Fu nct i on
Ini t i a l Va lu e
21:0
-
These bits are cleared.
0x0
21
DramAccess
0 - Access internal registers
1 - Access DRAM array
0x0
26:22
DevNum
Device Number.
These bits specify the GalNet Device Number.
DAddr[4:0] at RESET
31:27
BaseAdd
Galnet Protocol Region (GPR) Base Address.
These bits set the base address for the GalNet Proto-
col Region. All GalNet devices in a system must have
the same GPR base address (see text.)
0x1
Bi ts
Fi e l d Na m e
Fun cti o n
In iti a l Va l u e
7:0
IntLine
Interrupt Line.
Provides interrupt line routing information.
0x0
15:8
IntPin
Interrupt Pin.
Indicates which interrupt pin the GT-48002A uses.
The GT-48002A uses INTA in the PCI slot.
0x1
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PDF描述 |
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