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参数资料
| 型号： | HW-SPAR3A-SK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 129/143页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER W/SPARTAN-3A |
| 产品培训模块： | FPGAs Spartan3 |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 类型： | FPGA |
| 适用于相关产品： | Spartan?3A FPGA，XC3S700A-FG484 |
| 所含物品： | 板，线缆，文档，电源 |
| 相关产品： | XC3S700A-5FTG256C-ND - IC FPGA SPARTAN-3A 256K 256FTBGA 122-1722-ND - IC FPGA SPARTAN-3A 256K 256FTBGA XC3S700A-4FTG256C-ND - IC FPGA SPARTAN-3A 256K 256FTBGA XC3S700A-5FGG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-5FGG400C-ND - IC SPARTAN-3A FPGA 700K 400FBGA XC3S700A-5FG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-5FG400C-ND - IC SPARTAN-3A FPGA 700K 400FBGA XC3S700A-4FG484I-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-4FG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-4FGG484I-ND - IC SPARTAN-3A FPGA 700K 484FBGA 更多... |
| 其它名称： | 122-1514 |
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Table 15-4:
R
Differential I/O Connectors
association, the FPGA ball assignment, and the connecting header pin.
Differential I/O Connections and Header Connectsion
Differential Pair
Signal Name
FPGA Ball
FPGA Pin Name
Signal Direction
Header.Pin
“Receive” Header, J2 (Top Header)
RX_<0>
RX_<1>
RX_<2>
RX_<3>
RX_<4>
RX_CLK
RXN_<0>
RXP_<0>
RXN_<1>
RXP_<1>
RXN_<2>
RXP_<2>
RXN_<3>
RXP_<3>
RXN_<4>
RXP_<4>
RX_CLK_N
RX_CLK_P
B4
A4
A5
B6
A6
A7
A8
A9
C10
A10
A11
A12
IO_L31N_0
IO_L31P_0
IO_L28N_0
IO_L28P_0
IO_L26N_0
IO_L26P_0
IO_L22N_0
IO_L22P_0
IO_L21N_0
IO_L21P_0
IO_L18N_0
GLK7
IO_L18P_0
GCLK8
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
J2.6
J2.5
J2.10
J2.9
J2.14
J2.13
J2.22
J2.21
J2.26
J2.25
J2.30
J2.29
“Transmit” Header J15 (Bottom Header)
TX_<0>
TX_<1>
TX_<2>
TX_<3>
TX_<4>
TX_CLK
TXN_<0>
TXP_<0>
TXN_<1>
TXP_<1>
TXN_<2>
TXP_<2>
TXN_<3>
TXP_<3>
TXN_<4>
TXP_<4>
TX_CLK_N
TX_CLK_P
AA3
AB2
AA4
AB3
AB6
AA6
AB7
Y7
AB8
AA8
AB10
AA10
IO_L03N_2
IO_L03P_2
IO_L04N_2
IO_L04P_2
IO_L08N_2
IO_L08P_2
IO_L10N_2
IO_L10P_2
IO_L12N_2
IO_L12P_2
IO_L15N_2
IO_L15P_2
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
J1..6
J1.5
J1.10
J1.9
J1.14
J1.13
J1.22
J1.21
J1.26
J1.25
J1.30
J1.29
Using Differential Inputs
LVDS and RSDS differential inputs require input termination. Two options are generally
available. The first option is to use external termination resistors, as shown in Figure 15-4a .
External input termination resistors are not provided on the differential I/O pins.
The second option, called on-chip differential termination, is highlighted on the Spartan-
3A Starter Kit board (see Figure 15-4b ). This feature uses the DIFF_TERM attribute
available on differential I/O signals. Each differential I/O pin includes a circuit that
Spartan-3A FPGA Starter Kit Board User Guide
UG330 (v1.3) June 21, 2007
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