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参数资料
| 型号： | HW-SPAR3A-SK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 140/143页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER W/SPARTAN-3A |
| 产品培训模块： | FPGAs Spartan3 |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 类型： | FPGA |
| 适用于相关产品： | Spartan?3A FPGA，XC3S700A-FG484 |
| 所含物品： | 板，线缆，文档，电源 |
| 相关产品： | XC3S700A-5FTG256C-ND - IC FPGA SPARTAN-3A 256K 256FTBGA 122-1722-ND - IC FPGA SPARTAN-3A 256K 256FTBGA XC3S700A-4FTG256C-ND - IC FPGA SPARTAN-3A 256K 256FTBGA XC3S700A-5FGG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-5FGG400C-ND - IC SPARTAN-3A FPGA 700K 400FBGA XC3S700A-5FG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-5FG400C-ND - IC SPARTAN-3A FPGA 700K 400FBGA XC3S700A-4FG484I-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-4FG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-4FGG484I-ND - IC SPARTAN-3A FPGA 700K 484FBGA 更多... |
| 其它名称： | 122-1514 |
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Chapter 17: Voltage Supplies
R
regulators. Each regulator incorporates two high-current switching (buck) regulators and
two low-drop out (LDO) linear regulators.
Table 17-1:
Voltage Regulators and Supply Rails
Voltage
Regulator
National
Semiconductor
LP3906
(IC19)
National
Semiconductor
LP3906
(IC18)
Regulator
Output
SW1
SW2
LDO1
LDO2
SW1
SW2
LDO1
Voltage Level
1.2V
3.3V
3.3V
1.8V
0.9V
1.8V
3.3V
Series
Jumper
Control
J9
J10
J11
J12
J40
J13
J41
Components Supplied
FPGA internal core voltage,
VCCINT
FPGA I/O Banks 0, 1, and 2
(VCCO_0, VCCO_1, and
VCCO_2). All 3.3V
components.
FPGA internal auxiliary
voltage, VCCAUX
Embedded USB programmer
DDR2 SDRAM termination
network
DDR2 SDRAM component,
FPGA I/O Bank 3 (VCCO_3)
Voltage reference to D/A
converter channels C and D.
1.8V
DDR2 SDRAM voltage
LDO2
(voltage divided
to 0.9V)
J42
reference, FPGA I/O Bank 3
VREF inputs (VREF_3)
The board exploits all four regulator outputs for testing and evaluation purposes.
However, a typical Spartan-3A FPGA application uses far fewer rails.
?
The board uses a separate supply for VCCAUX and sets it to 3.3V by default. In a
typical application, the FPGA’s VCCAUX supply could connect directly to the 3.3V
supply used for FPGA I/O Banks 0, 1, and 2.
?
?
By default, the VCCAUX supply is set to 3.3V
Using the I 2 C interface on regulator IC19, VCCAUX can be reduced to 2.5V to
reduce overall power consumption or to verify operation with VCCAUX = 2.5V.
?
The DDR2 SDRAM interface uses multiple regulator outputs to test voltage
margining.
?
?
?
?
One high-current 1.8V rail supports the DDR2 SDRAM component itself, and
supplies the FPGA’s I/O Bank 3, which connects to the DDR2 SDRAM.
One high-current 0.9V supplies the DDR2 SDRAM termination network.
A low-current 1.8V supply is voltage divided with resistors to provide a high-
accuracy 0.9V voltage reference for the DDR2 SDRAM component and to supply
the VREF inputs on FPGA I/O Bank 3.
See Chapter 13, “DDR2 SDRAM” for additional information.
140
Spartan-3A FPGA Starter Kit Board User Guide
UG330 (v1.3) June 21, 2007
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