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参数资料
| 型号： | HW-SPAR3A-SK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 79/143页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER W/SPARTAN-3A |
| 产品培训模块： | FPGAs Spartan3 |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 类型： | FPGA |
| 适用于相关产品： | Spartan?3A FPGA，XC3S700A-FG484 |
| 所含物品： | 板，线缆，文档，电源 |
| 相关产品： | XC3S700A-5FTG256C-ND - IC FPGA SPARTAN-3A 256K 256FTBGA 122-1722-ND - IC FPGA SPARTAN-3A 256K 256FTBGA XC3S700A-4FTG256C-ND - IC FPGA SPARTAN-3A 256K 256FTBGA XC3S700A-5FGG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-5FGG400C-ND - IC SPARTAN-3A FPGA 700K 400FBGA XC3S700A-5FG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-5FG400C-ND - IC SPARTAN-3A FPGA 700K 400FBGA XC3S700A-4FG484I-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-4FG484C-ND - IC SPARTAN-3A FPGA 700K 484FBGA XC3S700A-4FGG484I-ND - IC SPARTAN-3A FPGA 700K 484FBGA 更多... |
| 其它名称： | 122-1514 |
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R
Programmable Pre-Amplifier
Finally, the ADC presents a 14-bit, two’s complement digital output. A 14-bit, two’s
complement number represents values between -2 13 and 2 13 -1. Therefore, the quantity is
scaled by 8192, or 2 13 .
See “Programmable Pre-Amplifier” to control the GAIN settings on the programmable
pre-amplifier.
The reference design files provide more information on converting the voltage applied on
VINA or VINB to a digital representation (see “Related Resources,” page 83 ).
Programmable Pre-Amplifier
The LTC6912-1 provides two independent, inverting amplifiers with programmable gain.
The purpose of the amplifier is to scale the incoming voltage on VINA or VINB so that it
maximizes the conversion range of the DAC, namely 1.65 ± 1.25V.
Interface
and SPI_SCK signals are shared with other devices on the SPI bus. The AMP_CS signal is
the active-Low slave select input to the amplifier.
Table 10-1:
AMP Interface Signals
Signal
SPI_MOSI
FPGA Pin
AB14
Direction
FPGA AMP
Description
Serial data: Master Output, Slave Input.
Presents eight-bit programmable gain
AMP_CS
W6
FPGA AMP
Active-Low chip-select. The amplifier gain is
set when the signal returns High.
SPI_SCK
AMP_SHDN
AMP_DOUT
AA20
W15
T7
FPGA AMP
FPGA AMP
FPGA AMP
Clock
Active-High shutdown, reset
Serial data. Echoes previous amplifier gain
settings. Can be ignored in most applications.
Programmable Gain
Each analog channel has an associated programmable gain amplifier (see Figure 10-2 ).
Analog signals presented on the VINA or VINB inputs on the J7 header are amplified
relative to 1.65V. The 1.65V reference is generated using a voltage divider of the 3.3V
voltage supply.
Table 10-2:
Programmable Gain Settings for Pre-Amplifier
A3
A2
A1
A0
Input Voltage Range
Gain
0
B3
0
B2
0
B1
0
B0
0
Minimum
Maximum
-1
-2
0
0
0
0
0
1
1
0
0.4
1.025
2.9
2.275
Spartan-3A FPGA Starter Kit Board User Guide
UG330 (v1.3) June 21, 2007
79
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