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参数资料
| 型号： | IDT72T6360L6BBGI |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA324 |
| 封装： | 19 X 19 MM, 1 MM PITCH, PLASTIC, BGA-324 |
| 文件页数： | 26/51页 |
| 文件大小： | 508K |
| 代理商： | IDT72T6360L6BBGI |
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32
IDT72T6360 2.5V, SEQUENTIAL FLOW-CONTROL DEVICE
x9, x18, x36 BIT WIDE CONFIGURATION
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
OCTOBER 10, 2005
Figure 6. Master Reset and Initialization
tRSF
IDT Standard Mode
Synchronous read port selected
Synchronous write port selected
If OE = HIGH
Asynchronous read port selected
Asynchronous write port selected
2.5V I/O voltage selected
MRS
REN
WEN
SREN
SWEN
EF
OR
FF
IR
CK
Q[35:0]
FWFT
ASYR
ASYW
IOSEL
PAF
PAE
IDEM
Depth Expansion in IDT Standard Mode
Depth Expansion in FWFT Standard Mode
tRSU
tRSF
tRSU
tRSF
If OE = LOW
tPL
tRSU
3.3V I/O voltage selected
The clock may not be locked to the required operating frequency before
tPL
The clock may not be locked to the required operating frequency before
tPL
tRS
tRSF
tRH
tRSU
6357 drw20
FWFT Mode
If FWFT mode is selected
If IDT mode is selected
If FWFT mode is selected
If IDT mode is selected
NOTE:
1. For other signals that are latched during master reset, refer to Master Reset and Device Configuration section.
Symbol
Parameter
Min.
Max.
Unit
tRS
Reset Pulse Width
10
—
ns
tRSU
ResetSetupTime
15
—
ns
tRSH
Reset Hold Time
10
—
ns
tPL
Reset to PLL Lock
20
—
s
tRSF
Reset to Flag and Output
—
15
ns
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