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参数资料
| 型号： | M38D59GC-XXXFP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 6.25 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 14 X 20 MM, 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件页数： | 75/142页 |
| 文件大小： | 2004K |
| 代理商： | M38D59GC-XXXFP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页当前第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页
Rev.3.04
May 20, 2008
REJ03B0158-0304
38D5 Group
16-bit Timer
Read and write operation on 16-bit timer must be performed for
both high and low-order bytes. When reading a 16-bit timer, read
the high-order byte first. When writing to a 16-bit timer, write
the low-order byte first. The 16-bit timer cannot perform the
correct operation when reading during the write operation, or
when writing during the read operation.
Fig. 28 Timer X block diagram
Data bus
1/2
1/4
Frequency
divider
Noise filter sampling
clock selection bit
“1”
“0”
Timer X interrupt
request
Timer X (high-order)(8)
Timer X (low-order)(8)
Timer X (high-order) latch (8)
Timer X (low-order) latch (8)
Equal
“000”
“001”
“010”
“011”
“101”
Pulse width
measurement
mode
Timer X count
stop bit
INT2
CNTR0 active
edge switch bits
Timer X operating
mode bits
CNTR0
interrupt request
“100”
Extend latch (2)
Timer X write
control bit
Timer 1 interrupt
D Q
Latch
Data for control of event counter window
CNTR0
INT00/INT01
0
s
External trigger delay time
selection bits
4/f(XIN)
“00”
“01”
“10”
“11”
8/f(XIN)
16/f(XIN)
Noise filter
(4 times same
levels judgment)
INT0
interrupt request
Timer X count source selection bit
XcIN
“1”
“0”
Clock for Timer X
XIN
Frequency divider
Timer X frequency
division selection bits
2
Both edges
detection
“00”
“01”
“10”
“11”
Timer X output
control bit 1
Timer X output
control bit 2
Timer X operating
mode bits
“010”
Delay
circuit
“000”
“001”
“011”
“100”
“101”
Timer X operating
mode bits
“010”
Compare register 3 (low-order)(8) Compare register 3 (high-order)(8)
Compare register 1 (low-order)(8) Compare register 1 (high-order)(8)
Compare register 2 (low-order)(8) Compare register 2 (high-order)(8)
Q
T
S
Pulse output mode
Timer X output 1
selection bit
P65
latch
P65
direction
register
P65/TXOUT1/(LED3)
Q
T
R
Timer X output 1
active edge switch
bit
“0”
“1”
IGBT output mode
PWM mode
Q
T
R
Timer X output 2
selection bit
P63
latch
P63
direction
register
P63/TXOUT2/(LED1)
Timer X output 2
active edge
switch bit
“0”
“1”
Extend counter (2)
φSOURCE
Note1:
φSOURCE indicates the followings:
XIN input in the frequency/2, 4, or 8 mode
On-chip oscillator divided by 4 in the on-chip oscillator mode
Sub-clock in the low-speed mode
“0”
“1”
Delay circuit 1/2
“1”
“0”
× 2
Trigger for IGBT input control bit
INT10/INT11
Edge
selection
Edge
selection
Edge
selection
Edge
detection
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PDF描述 |
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