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参数资料
型号： MC68EC060RC50
厂商： Freescale Semiconductor
文件页数： 65/128页
文件大小： 0K
描述： IC MPU 32BIT 50MHZ 206-PGA
标准包装： 10
系列： M680x0
处理器类型： M680x0 32-位
速度： 50MHz
电压： 3.3V
安装类型： 通孔
封装/外壳： 206-BEPGA
供应商设备封装： 206-PGA（47.25x47.25）
包装： 托盘
Introduction
MOTOROLA
M68060 USER’S MANUAL
1-17
CLR
0 Destination
CLR <ea>
CMP
Destination – Source cc
CMP <ea>,Dn
CMPA
Destination – Source
CMPA <ea>,An
CMPI
Destination – Immediate Data
CMPI #<data>,<ea>
CMPM
Destination – Source cc
CMPM (Ay)+,(Ax)+
CMP2
2
Compare Rn < LB or Rn > UB
and Set Condition Codes
CMP2 <ea>,Rn
CPUSH
If supervisor state
then if data cache push selected dirty data
cache lines; invalidate selected cache lines
else TRAP
CPUSHL <caches>, (An)
CPUSHP <caches>, (An)
CPUSHA <caches>
DBcc
If condition false
then (Dn–1 Dn;
If Dn
≠ –1
then PC + dn PC)
DBcc Dn,<label>
DIVS, DIVSL Destination
÷ Source Destination
DIVS.W <ea>,Dn32
÷ 16 16r:16q
DIVS.L <ea>,Dq32
÷ 32 32q
DIVS.L <ea>,Dr:Dq64
÷ 32 32r:32q2
DIVSL.L <ea>,Dr:Dq 32
÷ 32 32r:32q
DIVU, DIVUL Destination
÷ Source Destination
DIVU.W <ea>,Dn32
÷ 16 16r:16q
DIVU.L <ea>,Dq32
÷ 32 32q
DIVU.L <ea>,Dr:Dq64
÷ 32 32r:32q2
DIVUL.L <ea>,Dr:Dq32
÷ 32 32r:32q
EOR
Source
⊕ Destination Destination
EOR Dn,<ea>
EORI
Immediate Data
⊕ Destination Destination
EORI #<data>,<ea>
EORI to CCR Source
⊕ CCR CCR
EORI #<data>,CCR
EORI to SR
If supervisor state
then Source
⊕ SR SR
else TRAP
EORI #<data>,SR
EXG
Rx Ry
EXG Dx,Dy
EXG Ax,Ay
EXG Dx,Ay
EXG Ay,Dx
EXT
EXTB
Destination Sign – Extended Destination
EXT.W Dnextend byte to word
EXT.L L Dnextend word to long word
EXTB.L Dn extend byte to long word
FABS
Absolute Value of Source FPn
FABS.<fmt> <ea>,FPn
FABS.X FPm,FPn
FABS.X FPn
FrABS.<fmt> <ea>,FPn3
FrABS.X FPm,FPn3
FrABS.X FPn3
FADD
Source + FPn FPn
FADD.<fmt> <ea>,FPn
FADD.X FPm,FPn
FrADD.<fmt> <ea>,FPn3
FrADD.X FPm,FPn3
FBcc
If condition true
then PC + dn PC
FBcc.SIZE <label>
FCMP
FPn – Source
FCMP.<fmt> <ea>,FPn
FCMP.X FPm,FPn
FDBcc2
If condition true
then no operation
else Dn – 1 Dn
if Dn
≠ –1
then PC + dn PC
else execute next instruction
FDBcc Dn,<label>
FDIV
FPn
÷ Source FPn
FDIV.<fmt> <ea>,FPn
FDIV.X FPm,FPn
FrDIV.<fmt> <ea>,FPn3
FrDIV.X FPm,FPn3
Table 1-3. Instruction Set Summary (Continued)
Opcode
Operation
Syntax
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