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参数资料
| 型号： | OR4E041BM680-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1296 CLBS, 380000 GATES, PBGA680 |
| 封装： | PLASTIC, FBGA-680 |
| 文件页数： | 134/151页 |
| 文件大小： | 2680K |
| 代理商： | OR4E041BM680-DB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页当前第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页
Lattice Semiconductor
83
Data Sheet
September, 2002
ORCA Series 4 FPGAs
TimingCharacteristics(continued)
Table43.PIOInputBufferTimingCharacteristics
OR4Exx industrial: VDD15 = 1.425 V, VDD33 = 3.0 V, VDDIO = Min, TJ
=+85 °C.
Notes:
Thedelaysforallinputbuffersassumeaninputrise/falltimeof<1V/ns.
Thevaluesintheabovetableshouldbeusedtomodifytheresultsallinformationinthefollowingsystemtimingtables,whichareallbasedon
LVTTLinputtiming.
Parameter
Symbol
Speed
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
InputDelays
Input Rise Time
IN_RIS
—
100
—
100
—
100
ns
Input Fall Time
IN_FAL
—
100
—
100
—
100
ns
Input Delay Adjustments from LVTTL:
LVCMOS2 (2.5 V)
LVCMOS18 (1.8 V)
LVDS
LVPECL
PCI_33 (3.3 V)
PCI_66 (3.3 V)
GTL
GTLP (GTL+)
HSTL_I
HSTL_II
HSTL_III
HSTL_IV
SSTL2_I
SSTL2_II
SSTL3_I
SSTL3_II
PECL
IN_LVCMOS25
IN_LVCMOS15
IN_LVDS
IN_LVPECL
IN_PCI_33
IN_PCI_66
IN_GTL
IN_GTLP
IN_HSTL_I
IN_HSTL_II
IN_HSTL_III
IN_HSTL_IV
IN_SSTL2_I
IN_SSTL2_II
IN_SSTL3_I
IN_SSTL3_II
IN_PECL
—
0.54
1.91
–0.04
–0.31
0.59
5.32
1.87
–0.05
–0.20
2.28
0.78
0.83
—
0.44
1.50
0.10
–0.21
0.50
4.68
2.04
–0.06
–0.13
1.66
0.69
0.72
—
0.40
1.36
0.09
–0.19
0.45
4.26
1.86
–0.06
–0.12
1.51
0.63
0.65
ns
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