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参数资料
| 型号： | OR4E041BM680-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1296 CLBS, 380000 GATES, PBGA680 |
| 封装： | PLASTIC, FBGA-680 |
| 文件页数： | 145/151页 |
| 文件大小： | 2680K |
| 代理商： | OR4E041BM680-DB |
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Lattice Semiconductor
93
Data Sheet
September, 2002
ORCA Series 4 FPGAs
TimingCharacteristics(continued)
Table60.GeneralConfigurationModeTimingCharacteristics (continued)
OR4Exxx Industrial: VDD15 = 1.4 V to 1.6 V, VDD33 = 3.0 V to 3.6 V, VDDIO = 3.0 V to 3.6 V, –40 °C
< TJ
< +125 ° C;CL = 30 pF.
Note:TPOistriggeredwhenVDD33reachesbetween2.7Vand3.0V.
Parameter
Symbol
Min
Max
Unit
Slave Parallel Mode
Power-on Reset Delay
CCLK Period:
Conguration Latency (normal mode):
OR4E02
OR4E04
OR4E06
TPO
TCCLK
TCL
3.90
10.00
1.5
3.9
5.9
13.10
—
ms
ns
ms
Partial Reconguration (per data frame):
OR4E02
OR4E04
OR4E06
TPR
1.1
1.6
1.9
—
s
INIT Timing
INIT High to CCLK Delay:
Slave Parallel
Slave Serial
Master Serial
Master Parallel
TINIT_CCLK
0.50
1.60
s
Initialization Latency (PRGM high to INIT high):
OR4E02
OR4E04
OR4E06
TIL
0.43
0.58
0.74
1.44
1.95
2.46
ms
INIT High to WR, Asynchronous Peripheral
TINIT_WR
2.00
—
s
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