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参数资料
| 型号： | SII3114CT176 |
| 元件分类： | 总线控制器 |
| 英文描述： | PCI BUS CONTROLLER, PQFP176 |
| 封装： | TQFP-176 |
| 文件页数： | 94/127页 |
| 文件大小： | 564K |
| 代理商： | SII3114CT176 |
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SiI3114 PCI to Serial ATA Controller
Data Sheet
Silicon Image, Inc.
2007 Silicon Image, Inc.
61
SiI-DS-0103-D
FIFO Pointers1– Channel X
Address Offset: 68H / 78H / 268H / 278H
Access Type: Read Only
Reset Value: 0x0000_0000
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
FIFO Byte 1 Wr Pointer
FIFO Byte 1 Rd Pointer
FIFO Byte 0 Wr Pointer
FIFO Byte 0 Rd Pointer
This register provides visibility into the data FIFO for Channel X in the SiI3114. The data FIFO is organized as a
four byte-wide x 64 deep memory array. There are separate write and read pointers for each of the byte slices.
This register is used for hardware debugging purposes only. The register bits are defined below.
Bit [31:24]: FIFO Byte 1 Wr Pointer (R). This bit field provides the write pointer for Byte 1.
Bit [23:16]: FIFO Byte 1 Rd Pointer (R). This bit field provides the read pointer for Byte 1.
Bit [15:08]: FIFO Byte 0 Wr Pointer (R). This bit field provides the write pointer for Byte 0.
Bit [07:00]: FIFO Byte 0 Rd Pointer (R). This bit field provides the read pointer for Byte 0.
FIFO Pointers2– Channel X
Address Offset: 6CH / 7CH / 26CH / 27CH
Access Type: Read Only
Reset Value: 0x0000_0000
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 09 08 07 06 05 04 03 02 01 00
FIFO Byte 3 Wr Pointer
FIFO Byte 3 Rd Pointer
FIFO Byte 2 Wr Pointer
FIFO Byte 2 Rd Pointer
This register provides visibility into the data FIFO for Channel X in the SiI3114. The data FIFO is organized as a
four byte-wide x 64 deep memory array. There are separate write and read pointers for each of the byte slices.
This register is used for hardware debugging purposes only. The register bits are defined below.
Bit [31:24]: FIFO Byte 3 Wr Pointer (R). This bit field provides the write pointer for Byte 3.
Bit [23:16]: FIFO Byte 3 Rd Pointer (R). This bit field provides the read pointer for Byte 3.
Bit [15:08]: FIFO Byte 2 Wr Pointer (R). This bit field provides the write pointer for Byte 2.
Bit [07:00]: FIFO Byte 2 Rd Pointer (R). This bit field provides the read pointer for Byte 2.
相关PDF资料 |
PDF描述 |
|---|---|
| SII3114CTU | PCI BUS CONTROLLER, PQFP176 |
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相关代理商/技术参数 |
参数描述 |
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| SII3124A | 制造商:SILICONIMAGE 制造商全称:SILICONIMAGE 功能描述:PCI-X to Serial ATA Controller |
| SII3124ACBHU | 制造商:SILICONIMAGE 制造商全称:SILICONIMAGE 功能描述:PCI-X to Serial ATA Controller |
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