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参数资料
| 型号： | ST7267C8T1/XXX |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 30 MHz, RISC MICROCONTROLLER, PQFP48 |
| 封装： | 7 X 7 MM, LEAD FREE, TQFP-48 |
| 文件页数： | 63/189页 |
| 文件大小： | 1643K |
| 代理商： | ST7267C8T1/XXX |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页当前第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页
ST7267C8 ST7267R8
155/189
MSCI PARALLEL INTERFACE (Cont’d)
PARALLEL INTERFACE CONFIGURATION REGISTER 1 (PCR1)
Read / Write
Reset Value: 0000 0000 0111 1111 (007Fh)
Bit 15 = START Start communication.(write only)
This bit is set by software and is always read as 0.
Setting in this bit generates a start pulse that initi-
ates the data transfer. In input mode communica-
tion starts immediately (FIFO must be empty). In
output mode communication starts as soon as the
FIFO is full and copied into the buffer.
Important note: When using the PID bit of the
PCR2 register in the MSCI software, a reset of the
PID bit and the setting of the START bit must be
separated by a delay of at least 3 cycles. The use
of 3 additional single-cycle instructions following
the reset can be used for this purpose.
Bit 14:10 = Reserved.
Bit 9:8 = DM[1:0] Data Mode.
These bits are set and cleared by software.
When 8-bit output mode is used, data bytes are
sent to port P1[7:0] or P1[15:8] depending on
whether the LSB or MSB mode is selected. In 16-
bit mode, data is sent to P1[15:0]. When 8-bit
mode is used, the most significant byte is sent or
read first. The FSB bit in the PCR2 register can be
used to reverse byte order when writing into the
FIFO or reading from the FIFO (equivalent to
sending or reading least significant byte first).
00: 8-bit mode on LSB only
01: 8-bit mode on MSB only
10: 16-bit mode.
Bit 7 = DIR Direction.
This bit is set and cleared by software.
In output mode the data ports used are forced to
output mode by the parallel interface when data is
to be output. In input mode the data ports can be
controlled by the MSCI I/O controller registers.
Data ports must be left in input mode so they can
be driven by external device.
0: Input mode
1: Output mode
Bit 6:4 = F[2:0] Frequency prescaler.
These bits are set and cleared by software. They
select the prescaler factor for the control signal
(applied to the 60 MHz clock)
Bit 3 = CP Clock Polarity.
This bit is set and cleared by software.
0: Falling edge clock pulse
1: Rising edge clock pulse
Bit 2:0 = CSS[2:0] Control Signal Shape.
These bits are set and cleared by software.
They are used to select the clock edge position in
the clock cycle by steps of 16.66ns and thus, con-
trol the clock duty cycle. CSS[2:0] must be lower
than F[2:0] or equal to F (Frequency selection) and
greater than 0.
For more detailed description of the control
signal generation refer to chapter "CONFIGURA-
TION OF THE CONTROL LINE SIGNALS"
15
8
7
0
START
-
DM1
DM0
DIR
F2
F1
F0
CP
CSS2
CSS1
CSS0
F[2] F[1] F[0] Control Signal Frequency
0
Not allowed
001
30MHz
010
20MHz
011
15MHz
100
12MHz
101
10MHz
1
0
8.5MHz
1
7.5MHz
相关PDF资料 |
PDF描述 |
|---|---|
| ST72774S9T1/XXX | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP44 |
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参数描述 |
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