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参数资料
| 型号： | TMX20F2810PBKAEP |
| 厂商： | Texas Instruments, Inc. |
| 元件分类： | 数字信号处理 |
| 英文描述： | Digital Signal Processors |
| 中文描述： | 数字信号处理器 |
| 文件页数： | 122/159页 |
| 文件大小： | 2084K |
| 代理商： | TMX20F2810PBKAEP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页当前第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页
Electrical Specifications
121
March 2004 Revised October 2004
SGUS051A
If the XREADY signal is sampled in the Synchronous mode (USEREADY = 1, READYMODE = 0), then:
1.
Lead:
LR
≥
t
c(XTIM)
LW
≥
t
c(XTIM)
AR
≥
2 x t
c(XTIM)
AW
≥
2 x t
c(XTIM)
2.
Active:
NOTE
: Restriction does not include external hardware wait states
These requirements result in the following XTIMING register configuration restrictions
:
XRDLEAD
≥
1
No hardware to detect illegal XTIMING configurations
XRDACTIVE
≥
1
XRDTRAIL
≥
0
XWRLEAD
≥
1
XWRACTIVE
≥
1
XWRTRAIL
≥
0
X2TIMING
0, 1
Examples of valid and invalid timing when using Synchronous XREADY
:
XRDLEAD
XRDACTIVE
XRDTRAIL
XWRLEAD
XWRACTIVE
XWRTRAIL
X2TIMING
Invalid
0
0
0
0
0
0
0, 1
Invalid
1
0
0
1
0
0
0, 1
Valid
No hardware to detect illegal XTIMING configurations
1
1
0
1
1
0
0, 1
If the XREADY signal is sampled in the Asynchronous mode (USEREADY = 1, READYMODE = 1), then:
1.
Lead:
LR
≥
t
c(XTIM)
LW
≥
t
c(XTIM)
AR
≥
2 x t
c(XTIM)
AW
≥
2 x t
c(XTIM)
2.
Active:
NOTE
: Restriction does not include external hardware wait states
3.
Lead + Active:
LR + AR
≥
4 x t
c(XTIM)
LW + AW
≥
4 x t
c(XTIM)
NOTE
: Restriction does not include external hardware wait states
These requirements result in the following XTIMING register configuration restrictions
:
XRDLEAD
≥
1
No hardware to detect illegal XTIMING configurations
or
XRDACTIVE
≥
2
XRDTRAIL
XWRLEAD
≥
1
XWRACTIVE
≥
2
XWRTRAIL
X2TIMING
0
0
0, 1
XRDLEAD
≥
2
No hardware to detect illegal XTIMING configurations
XRDACTIVE
≥
1
XRDTRAIL
XWRLEAD
≥
2
XWRACTIVE
≥
1
XWRTRAIL
X2TIMING
0
0
0, 1
Examples of valid and invalid timing when using Asynchronous XREADY
:
XRDLEAD
XRDACTIVE
XRDTRAIL
XWRLEAD
XWRACTIVE
XWRTRAIL
X2TIMING
Invalid
0
0
0
0
0
0
0, 1
Invalid
1
0
0
1
0
0
0, 1
Invalid
1
1
0
1
1
0
0
Valid
1
1
0
1
1
0
1
Valid
1
2
0
1
2
0
0, 1
Valid
No hardware to detect illegal XTIMING configurations
2
1
0
2
1
0
0, 1
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