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参数资料
| 型号： | TMX20F2810PBKAEP |
| 厂商： | Texas Instruments, Inc. |
| 元件分类： | 数字信号处理 |
| 英文描述： | Digital Signal Processors |
| 中文描述： | 数字信号处理器 |
| 文件页数： | 146/159页 |
| 文件大小： | 2084K |
| 代理商： | TMX20F2810PBKAEP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页当前第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页
Electrical Specifications
144
March 2004 Revised October 2004
SGUS051A
Table 645. McBSP Switching Characteristics
NO.
PARAMETER
MIN
MAX
UNIT
M1
tc(CKRX)
tw(CKRXH)
tw(CKRXL)
Cycle time, CLKR/X
CLKR/X int
2P
ns
M2
Pulse duration, CLKR/X high
CLKR/X int
D5§
C5§
D+5§
C+5§
ns
M3
Pulse duration, CLKR/X low
CLKR/X int
ns
M4
td(CKRH-FRV)
Delay time, CLKR high to internal FSR valid
CLKR int
0
4
ns
CLKR ext
3
27
ns
M5
td(CKXH-FXV)
Delay time, CLKX high to internal FSX valid
CLKX int
0
4
ns
CLKX ext
3
27
M6
tdis(CKXH-DXHZ)
Disable time, CLKX high to DX high impedance
following last data bit
CLKX int
8
ns
CLKX ext
14
Delay time, CLKX high to DX valid.
This applies to all bits except the first bit transmitted.
CLKX int
9
CLKX ext
28
M7
td(CKXH-DXV)
DXENA = 0
CLKX int
8
Delay time, CLKX high to DX valid
CLKX ext
14
ns
Only applies to first bit transmitted when in Data
Delay 1 or 2 (XDATDLY=01b or 10b) modes
DXENA = 1
CLKX int
P + 8
CLKX ext
P + 14
DXENA = 0
CLKX int
0
M8
ten(CKXH-DX)
Enable time, CLKX high to DX driven
CLKX ext
6
ns
Only applies to first bit transmitted when in Data
Delay 1 or 2 (XDATDLY=01b or 10b) modes
DXENA = 1
CLKX int
P
CLKX ext
P + 6
DXENA = 0
FSX int
8
M9
td(FXH-DXV)
Delay time, FSX high to DX valid
FSX ext
14
ns
Only applies to first bit transmitted when in Data
Delay 0 (XDATDLY=00b) mode.
DXENA = 1
FSX int
P + 8
FSX ext
P + 14
DXENA = 0
FSX int
0
M10
ten(FXH-DX)
Enable time, FSX high to DX driven
FSX ext
6
ns
Only applies to first bit transmitted when in Data
Delay 0 (XDATDLY=00b) mode
DXENA = 1
FSX int
P
FSX ext
P + 6
Polarity bits CLKRP = CLKXP = FSRP = FSXP = 0. If the polarity of any of the signals is inverted, then the timing references of
that signal are
also inverted.
2P = 1/CLKG in ns.
§C=CLKRX low pulse width = P
D=CLKRX high pulse width = P
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