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参数资料
| 型号： | WJLXT388LEB2 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封装： | 14 X 14MM, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 40/80页 |
| 文件大小： | 1017K |
| 代理商： | WJLXT388LEB2 |
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Dual T1/E1/J1 Transceiver — Intel
LXT388
Datasheet
45
Table 30. Output Enable Register, OER (12H)
Bit1
Name
Function
1-0
OE1 - OE0
Setting a bit to “1” tristates the output driver of the corresponding transceiver.
7-2
-
Write “0” to these positions for normal operation.
1. On power-up all the register bits are set to “0”.
Table 31. AIS Status Monitor Register, AIS (13H)
Bit1
Name
Function
3-0
AIS3-AIS0
Respective bit(s) are set to “1” every time the receiver detects a AIS condition in receivers
3-0.
1. On power-up all the register bits are set to “0”. All AIS interrupts are cleared by a single read operation.
Table 32. AIS Interrupt Enable Register, AISIE (14H)
Bit
1
Name
Function
3-0
AISIE3-AISIE0
Transceiver 3-0 AIS interrupts are enabled by writing a “1” to the respective bit.
7-4
-
Write “0” to these positions for normal operation.
1. On power-up all the register bits are set to “0”.
Table 33. AIS Interrupt Status Register, AISIS (15H)
Bit1
Name
Function
3-0
AISIS3-AISIS0
These bits are set to “1” every time a AIS status change has occurred since the last clear
interrupt in receivers 3-0 respectively.
1. On power-up all the register bits are set to “0”.
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